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74LVQ138SJX

更新时间: 2024-11-20 04:47:51
品牌 Logo 应用领域
飞兆/仙童 - FAIRCHILD 解码器驱动器解复用器逻辑集成电路光电二极管
页数 文件大小 规格书
8页 102K
描述
Low Voltage 1-of-8 Decoder/Demultiplexer

74LVQ138SJX 技术参数

是否Rohs认证: 符合生命周期:Obsolete
零件包装代码:SOIC包装说明:5.30 MM, EIAJ TYPE2, SOP-16
针数:16Reach Compliance Code:compliant
ECCN代码:EAR99HTS代码:8542.39.00.01
风险等级:5.35Is Samacsys:N
系列:LVQJESD-30 代码:R-PDSO-G16
JESD-609代码:e3长度:10.2 mm
负载电容(CL):50 pF逻辑集成电路类型:OTHER DECODER/DRIVER
最大I(ol):0.012 A湿度敏感等级:1
功能数量:1端子数量:16
最高工作温度:85 °C最低工作温度:-40 °C
输出极性:INVERTED封装主体材料:PLASTIC/EPOXY
封装代码:SOP封装等效代码:SOP16,.3
封装形状:RECTANGULAR封装形式:SMALL OUTLINE
包装方法:TAPE AND REEL峰值回流温度(摄氏度):260
电源:3.3 VProp。Delay @ Nom-Sup:15 ns
传播延迟(tpd):21 ns认证状态:Not Qualified
座面最大高度:2.1 mm子类别:Decoder/Drivers
最大供电电压 (Vsup):3.6 V最小供电电压 (Vsup):2 V
标称供电电压 (Vsup):2.7 V表面贴装:YES
技术:CMOS温度等级:INDUSTRIAL
端子面层:Matte Tin (Sn)端子形式:GULL WING
端子节距:1.27 mm端子位置:DUAL
处于峰值回流温度下的最长时间:NOT SPECIFIED宽度:5.3 mm
Base Number Matches:1

74LVQ138SJX 数据手册

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May 1998  
74LVQ138  
Low Voltage 1-of-8 Decoder/Demultiplexer  
General Description  
Features  
n Ideal for low power/low noise 3.3V applications  
The LVQ138 is a high-speed 1-of-8 decoder/demultiplexer.  
This device is ideally suited for high-speed bipolar memory  
chip select address decoding. The multiple input enables al-  
low parallel expansion to a 1-of-24 decoder using just three  
LVQ138 devices or a 1-of-32 decoder using four LVQ138 de-  
vices and one inverter.  
n Guaranteed simultaneous switching noise level and  
dynamic threshold performance  
n Improved latch-up immunity  
n Guaranteed incident wave switching into 75  
n 4 kV minimum ESD immunity  
n Demultiplexing capability  
n Multiple input enable for each expansion  
n Active LOW mutually exclusive outputs  
Ordering Code:  
Order Number  
74LVQ138SC  
74LVQ138SJ  
Package Number  
M16A  
Package Description  
16-Lead (0.150" Wide) Small Outline Integrated Circuit, SOIC JEDEC  
16-Lead Molded Small Outline Package, SOIC EIAJ  
M16D  
Devices also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering code.  
Logic Symbols  
Connection Diagram  
Pin Assignment  
for SOIC JEDEC and EIAJ  
DS011350-1  
IEEE/IEC  
DS011350-2  
Pin Descriptions  
Pin Names  
Description  
Address Inputs  
A0–A2  
E1–E2  
E3  
Enable Inputs  
Enable Input  
Outputs  
DS011350-4  
O0–O7  
© 1998 Fairchild Semiconductor Corporation  
DS011350  
www.fairchildsemi.com  

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