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74LVC574ABQ,115 PDF预览

74LVC574ABQ,115

更新时间： 2023-08-15 00:00:00
品牌 Logo 应用领域
恩智浦 - NXP 驱动逻辑集成电路
页数 文件大小 规格书
19页 137K
描述
74LVC574A - Octal D-type flip-flop with 5 V tolerant inputs/outputs; positive edge-trigger (3-state) QFN 20-Pin

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74LVC574ABQ,115 技术参数

是否Rohs认证： 符合生命周期：Active
零件包装代码：QFN包装说明：HVQCCN,
针数：20Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：1.07
系列：LVC/LCX/ZJESD-30 代码：R-PQCC-N20
JESD-609代码：e4长度：4.5 mm
逻辑集成电路类型：BUS DRIVER湿度敏感等级：1
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：125 °C最低工作温度：-40 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：HVQCCN
封装形状：RECTANGULAR封装形式：CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）：260传播延迟（tpd）：10 ns
认证状态：Not Qualified座面最大高度：1 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：1.2 V
标称供电电压 (Vsup)：2.7 V表面贴装：YES
技术：CMOS温度等级：AUTOMOTIVE
端子面层：Nickel/Palladium/Gold/Silver (Ni/Pd/Au/Ag)端子形式：NO LEAD
端子节距：0.5 mm端子位置：QUAD
处于峰值回流温度下的最长时间：30宽度：2.5 mm
Base Number Matches：1

74LVC574ABQ,115 数据手册

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74LVC574A  
Octal D-type flip-flop with 5 V tolerant inputs/outputs; positive  
edge-trigger; 3-state  
Rev. 5 — 18 December 2012  
Product data sheet  
1. General description  
The 74LVC574A is an octal D-type flip-flop featuring separate D-type inputs for each  
flip-flop and 3-state outputs for bus-oriented applications. A clock (CP) and an Output  
Enable (OE) input are common to all flip-flops.  
The eight flip-flops will store the state of their individual D-inputs that meet the set-up and  
hold times requirements on the LOW to HIGH CP transition.  
When OE is LOW, the contents of the eight flip-flops are available at the outputs. When  
OE is HIGH, the outputs go to the high-impedance OFF-state. Operation of the OE input  
does not affect the state of the flip-flops.  
Inputs can be driven from either 3.3 V or 5 V devices. When disabled, up to 5.5 V can be  
applied to the outputs. These features allow the use of these devices as translators in  
mixed 3.3 V or 5 V applications.  
The 74LVC574A is functionally identical to the 74LVC374A, but has a different pin  
arrangement.  
2. Features and benefits  
5 V tolerant inputs for interfacing with 5 V logic  
Supply voltage range from 1.2 V to 3.6 V  
CMOS low power consumption  
Direct interface with TTL levels  
High-impedance when VCC = 0 V  
8-bit positive edge-triggered register  
Independent register and 3-state buffer operation  
Flow-through pin-out architecture  
Complies with JEDEC standard:  
JESD8-7A (1.65 V to 1.95 V)  
JESD8-5A (2.3 V to 2.7 V)  
JESD8-C/JESD36 (2.7 V to 3.6 V)  
ESD protection:  
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-B exceeds 200 V  
CDM JESD22-C101E exceeds 1000 V  
Specified from 40 C to +85 C and 40 C to +125 C  
1234567...19

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74LVC574ABQ,115 替代型号

型号 品牌 替代类型 描述 数据表
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