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74LVC3G17DC

更新时间： 2024-10-03 11:10:39

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安世 - NEXPERIA		光电二极管逻辑集成电路
页数	文件大小	规格书
17页	273K
描述
Triple non-inverting Schmitt trigger with 5 V tolerant inputProduction

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74LVC3G17DC 技术参数

是否Rohs认证：	符合	生命周期：	Active
包装说明：	VSSOP-8	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	5.59
Is Samacsys：	N	系列：	LVC/LCX/Z
JESD-30 代码：	R-PDSO-G8	JESD-609代码：	e4
长度：	2.3 mm	逻辑集成电路类型：	BUFFER
湿度敏感等级：	1	功能数量：	3
输入次数：	1	端子数量：	8
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	VSSOP
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, VERY THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	传播延迟（tpd）：	13.1 ns
座面最大高度：	1 mm	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	1.65 V	标称供电电压 (Vsup)：	1.8 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	2 mm	Base Number Matches：	1

74LVC3G17DC 数据手册

74LVC3G17

Triple non-inverting Schmitt trigger with 5 V tolerant input

Rev. 14 — 26 August 2021

Product data sheet

1. General description

The 74LVC3G17 is a triple buffer with Schmitt-trigger inputs. Inputs can be driven from either 3.3 V

or 5 V devices. This feature allows the use of these devices as translators in mixed 3.3 V and 5 V

environments.

This device is fully specified for partial power down applications using I_OFF. The I_OFFcircuitry

disables the output, preventing the potentially damaging backflow current through the device when

it is powered down.

2. Features and benefits

•

Wide supply voltage range from 1.65 V to 5.5 V

•

Overvoltage tolerant inputs to 5.5 V

High noise immunity

±24 mA output drive (V_CC= 3.0 V)

CMOS low-power consumption

Latch-up performance exceeds 250 mA

Direct interface with TTL levels

I_OFFcircuitry provides partial Power-down mode operation

Complies with JEDEC standards

•

JESD8-7 (1.65 V to 1.95 V)

JESD8-5 (2.3 V to 2.7 V)

JESD8C (2.7 V to 3.6 V)

JESD36 (4.5 V to 5.5 V)

•

ESD protection:

•

HBM JESD22-A114F exceeds 2000 V

MM JESD22-A115-A exceeds 200 V

•

Multiple package options

Specified from -40 °C to +85 °C and -40 °C to +125 °C

3. Applications

•

Wave and pulse shapers for highly noisy environments

12 3 4 5 6 7...17

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与74LVC3G17DC相关器件

型号	品牌	获取价格	描述	数据表
74LVC3G17DC,125	NXP	获取价格	74LVC3G17 - Triple non-inverting Schmitt trigger with 5 V tolerant input SSOP 8-Pin
74LVC3G17DC,132	NXP	获取价格	Buffer, LVC/LCX/Z Series, 3-Func, 1-Input, CMOS, PDSO8
74LVC3G17DC-G	NXP	获取价格	Triple non-inverting Schmitt trigger with 5 V tolerant input - Description: Triple Schmitt
74LVC3G17DC-Q100	NXP	获取价格	IC NON-INVERT GATE, Gate
74LVC3G17DC-Q100	NEXPERIA	获取价格	Triple non-inverting Schmitt trigger with 5 V tolerant input
74LVC3G17DP	NXP	获取价格	Triple non-inverting Schmitt trigger with 5 V tolerant input
74LVC3G17DP	NEXPERIA	获取价格	Triple non-inverting Schmitt trigger with 5 V tolerant inputProduction
74LVC3G17DP-Q100	NEXPERIA	获取价格	Triple non-inverting Schmitt trigger with 5 V tolerant input
74LVC3G17DP-Q100,125	NXP	获取价格	Buffer, LVC/LCX/Z Series, 3-Func, 1-Input, CMOS, PDSO8
74LVC3G17GD	NXP	获取价格	Triple non-inverting Schmitt trigger with 5 V tolerant input

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