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74LVC373ADB-Q100

更新时间： 2024-09-24 01:07:59
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安世 - NEXPERIA 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
19页 741K
描述
Octal D-type transparent latch with 5 V tolerant

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74LVC373ADB-Q100 技术参数

是否Rohs认证： 符合生命周期：Obsolete
包装说明：SSOP,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.56
系列：LVC/LCX/ZJESD-30 代码：R-PDSO-G20
长度：7.2 mm逻辑集成电路类型：BUS DRIVER
湿度敏感等级：1位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, SHRINK PITCH峰值回流温度（摄氏度）：260
传播延迟（tpd）：19.3 ns筛选级别：AEC-Q100
座面最大高度：2 mm最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：1.2 V标称供电电压 (Vsup)：3.3 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
处于峰值回流温度下的最长时间：30宽度：5.3 mm
Base Number Matches：1

74LVC373ADB-Q100 数据手册

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74LVC373A-Q100  
Octal D-type transparent latch with 5 V tolerant  
inputs/outputs; 3-state  
Rev. 1 — 17 April 2013  
Product data sheet  
1. General description  
The 74LVC373A-Q100 consists of eight D-type transparent latches, featuring separate  
D-type inputs for each latch and 3-state true outputs for bus-oriented applications. A latch  
enable input (pin LE) and an output enable input (pin OE) are common to all internal  
latches.  
When pin LE is HIGH, data at the D-inputs (pins D0 to D7) enters the latches. In this  
condition, the latches are transparent, that is, a latch output changes each time its  
corresponding D-input changes. When pin LE is LOW, the latches store the information  
that was present at the D-inputs one set-up time preceding the HIGH-to-LOW transition of  
pin LE. When pin OE is LOW, the contents of the eight latches are available at the  
Q-outputs (pins Q0 to Q7). When pin OE is HIGH, the outputs go to the high-impedance  
OFF-state. Operation of input pin OE does not affect the state of the latches. Inputs can  
be driven from either 3.3 V or 5 V devices. When disabled, up to 5.5 V can be applied to  
the outputs. These features allow the use of these devices as translators in mixed 3.3 V  
and 5 V applications. The 74LVC373A-Q100 is functionally identical to the  
74LVC573A-Q100, but has a different pin arrangement.  
This product has been qualified to the Automotive Electronics Council (AEC) standard  
Q100 (Grade 1) and is suitable for use in automotive applications.  
2. Features and benefits  
Automotive product qualification in accordance with AEC-Q100 (Grade 1)  
Specified from 40 C to +85 C and from 40 C to +125 C  
5 V tolerant inputs/outputs for interfacing with 5 V logic  
Wide supply voltage range from 1.2 V to 3.6 V  
CMOS low power consumption  
Direct interface with TTL levels  
High-impedance outputs when VCC = 0 V  
Complies with JEDEC standard:  
JESD8-7A (1.65 V to 1.95 V)  
JESD8-5A (2.3 V to 2.7 V)  
JESD8-C/JESD36 (2.7 V to 3.6 V)  
ESD protection:  
MIL-STD-883, method 3015 exceeds 2000 V  
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V (C = 200 pF, R = 0 )  
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