Source Url Status Check Date: | 2013-06-14 00:00:00 | 是否无铅: | 不含铅 |
是否Rohs认证: | 符合 | 生命周期: | Obsolete |
包装说明: | DIP, DIP16,.3 | Reach Compliance Code: | unknown |
HTS代码: | 8542.39.00.01 | 风险等级: | 5.7 |
系列: | LV/LV-A/LVX/H | JESD-30 代码: | R-PDIP-T16 |
JESD-609代码: | e4 | 长度: | 19.025 mm |
负载电容(CL): | 50 pF | 逻辑集成电路类型: | D FLIP-FLOP |
最大频率@ Nom-Sup: | 20000000 Hz | 最大I(ol): | 0.006 A |
位数: | 6 | 功能数量: | 1 |
端子数量: | 16 | 最高工作温度: | 125 °C |
最低工作温度: | -40 °C | 输出极性: | TRUE |
封装主体材料: | PLASTIC/EPOXY | 封装代码: | DIP |
封装等效代码: | DIP16,.3 | 封装形状: | RECTANGULAR |
封装形式: | IN-LINE | 峰值回流温度(摄氏度): | NOT SPECIFIED |
电源: | 3.3 V | Prop。Delay @ Nom-Sup: | 31 ns |
传播延迟(tpd): | 31 ns | 认证状态: | Not Qualified |
座面最大高度: | 4.2 mm | 子类别: | FF/Latches |
最大供电电压 (Vsup): | 5.5 V | 最小供电电压 (Vsup): | 1 V |
标称供电电压 (Vsup): | 3.3 V | 表面贴装: | NO |
技术: | CMOS | 温度等级: | AUTOMOTIVE |
端子面层: | Nickel/Palladium/Gold (Ni/Pd/Au) | 端子形式: | THROUGH-HOLE |
端子节距: | 2.54 mm | 端子位置: | DUAL |
处于峰值回流温度下的最长时间: | NOT SPECIFIED | 触发器类型: | POSITIVE EDGE |
宽度: | 7.62 mm | 最小 fmax: | 20 MHz |
Base Number Matches: | 1 |
型号 | 品牌 | 获取价格 | 描述 | 数据表 |
74LV174N,112 | NXP |
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LV/LV-A/LVX/H SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDIP16 | |
74LV174PW | NXP |
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Hex D-type flip-flop with reset; positive-edge trigger | |
74LV174PW,112 | NXP |
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IC LV/LV-A/LVX/H SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO16, 4.40 MM | |
74LV174PW,118 | NXP |
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IC LV/LV-A/LVX/H SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO16, 4.40 MM | |
74LV174PWDH | NXP |
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Hex D-type flip-flop with reset; positive-edge trigger | |
74LV174PW-T | ETC |
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Hex D-Type Flip-Flop | |
74LV175 | TI |
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QUADRUPLE D-TYPE FLIP-FLOPS WITH CLEAR | |
74LV175 | HITACHI |
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Quad. D-type Flip-Flops with Clear | |
74LV175D | NXP |
获取价格 |
IC LV/LV-A/LVX/H SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16 | |
74LV175DB | NXP |
获取价格 |
IC LV/LV-A/LVX/H SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16 |