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Datasheet > 逻辑 > 总线驱动器/收发器> 74LCX646M1R
74LCX646M1R PDF预览

74LCX646M1R

更新时间： 2024-11-07 03:00:59
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 总线驱动器总线收发器触发器逻辑集成电路光电二极管输出元件输入元件
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16页 421K
描述
LOW VOLT. CMOS OCTAL BUS TRANSCEIVER/REGISTER WITH 5 VOLT TOLERANT INPUTS AND OUTPUTS(3-STATE)

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74LCX646M1R 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP-24
针数：24Reach Compliance Code：compliant
风险等级：5.16Is Samacsys：N
控制类型：INDEPENDENT CONTROL计数方向：BIDIRECTIONAL
系列：LVC/LCX/ZJESD-30 代码：R-PDSO-G24
JESD-609代码：e4长度：15.4 mm
逻辑集成电路类型：REGISTERED BUS TRANSCEIVER最大I（ol）：0.024 A
位数：8功能数量：1
端口数量：2端子数量：24
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：PLASTIC/EPOXY封装代码：SOP
封装等效代码：SOP24,.4封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：NOT SPECIFIED
电源：3.3 VProp。Delay @ Nom-Sup：7 ns
传播延迟（tpd）：9.5 ns认证状态：Not Qualified
座面最大高度：2.65 mm子类别：Bus Driver/Transceivers
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：2.7 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED翻译：N/A
触发器类型：POSITIVE EDGE宽度：7.5 mm
Base Number Matches：1

74LCX646M1R 数据手册

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74LCX646  
LOW VOLT. CMOS OCTAL BUS TRANSCEIVER/REGISTER  
WITH 5 VOLT TOLERANT INPUTS AND OUTPUTS(3-STATE)  
■
5V TOLERANT INPUTS AND OUTPUTS  
HIGH SPEED:  
■
■
■
t
= 7.0 ns (MAX.) at V = 3V  
PD  
CC  
POWER DOWN PROTECTION ON INPUTS  
AND OUTPUTS  
SYMMETRICAL OUTPUT IMPEDANCE:  
SOP  
TSSOP  
T & R  
|I | = I = 24mA (MIN) at V = 3V  
OH  
OL  
CC  
■
■
PCI BUS LEVELS GUARANTEED AT 24 mA  
BALANCED PROPAGATION DELAYS:  
Table 1: Order Codes  
PACKAGE  
t
t
PLH  
PHL  
■
OPERATING VOLTAGE RANGE:  
(OPR) = 2.0V to 3.6V (1.5V Data  
SOP  
74LCX646RM13TR  
74LCX646TTR  
V
CC  
TSSOP  
Retention)  
■
■
■
PIN AND FUNCTION COMPATIBLE WITH  
74 SERIES 646  
This device consists of bus transceiver circuits  
with 3 state, D-type flip-flops, and control circuitry  
arranged for multiplexed transmission of data  
directly from the input bus or from the internal  
registers. Data on the A or B bus will be clocked  
into register on the low to high transition of the  
appropriate clock pin (Clock AB or Clock BA).  
Enable (G) and direction (DIR) pins are provided  
to control the transceiver functions. In the  
transceiver mode, data present at the  
high-impedance port may be stored in either  
register or in both. The select controls (Select AB  
select BA) can multiplex stored and real time  
(transparent mode) data. The direction control  
determines which bus will receive data when  
enable G is active (low). In the isolation mode  
LATCH-UP PERFORMANCE EXCEEDS  
500mA (JESD 17)  
ESD PERFORMANCE:  
HBM > 2000V (MIL STD 883 method 3015);  
MM > 200V  
DESCRIPTION  
The 74LCX646 is a low voltage CMOS OCTAL  
BUS  
(3-STATE) fabricated with sub-micron silicon gate  
and double-layer metal wiring C MOS technology.  
It is ideal for low power and high speed 3.3V  
applications; it can be interfaced to 5V signal  
environment for both inputs and outputs.  
TRANSCEIVER  
AND  
REGISTER  
2
Figure 1: Pin Connection And IEC Logic Symbols  
Rev. 6  
1/16  
September 2004  
1234567...16

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