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74LCX240TTRG

更新时间： 2024-11-26 21:18:59
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 驱动光电二极管输出元件逻辑集成电路
页数 文件大小 规格书
12页 294K
描述
LVC/LCX/Z SERIES, DUAL 4-BIT DRIVER, INVERTED OUTPUT, PDSO20, TSSOP-20

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74LCX240TTRG 技术参数

生命周期：Obsolete包装说明：TSSOP,
Reach Compliance Code：unknownHTS代码：8542.39.00.01
风险等级：5.64系列：LVC/LCX/Z
JESD-30 代码：R-PDSO-G20长度：6.5 mm
逻辑集成电路类型：BUS DRIVER位数：4
功能数量：2端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：INVERTED封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH传播延迟（tpd）：8.5 ns
座面最大高度：1.2 mm最大供电电压 (Vsup)：3.6 V
最小供电电压 (Vsup)：2 V标称供电电压 (Vsup)：2.7 V
表面贴装：YES技术：CMOS
温度等级：MILITARY端子形式：GULL WING
端子节距：0.65 mm端子位置：DUAL
宽度：4.4 mmBase Number Matches：1

74LCX240TTRG 数据手册

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74LCX240  
LOW VOLTAGE CMOS OCTAL BUS BUFFER (3-STATE INV.)  
WITH 5V TOLERANT INPUTS AND OUTPUTS  
■
5V TOLERANT INPUTS AND OUTPUTS  
HIGH SPEED:  
■
■
■
t
= 6.5 ns (MAX.) at V = 3V  
PD  
CC  
POWER DOWN PROTECTION ON INPUTS  
AND OUTPUTS  
SYMMETRICAL OUTPUT IMPEDANCE:  
SOP  
TSSOP  
|I | = I = 24mA (MIN) at V = 3V  
OH  
OL  
CC  
■
■
PCI BUS LEVELS GUARANTEED AT 24 mA  
BALANCED PROPAGATION DELAYS:  
Table 1: Order Codes  
PACKAGE  
t
t
PLH  
PHL  
■
OPERATING VOLTAGE RANGE:  
(OPR) = 2.0V to 3.6V (1.5V Data  
T & R  
V
CC  
SOP  
74LCX240MTR  
74LCX240TTR  
Retention)  
TSSOP  
■
■
■
PIN AND FUNCTION COMPATIBLE WITH  
74 SERIES 240  
LATCH-UP PERFORMANCE EXCEEDS  
500mA (JESD 17)  
ESD PERFORMANCE:  
HBM > 2000V (MIL STD 883 method 3015);  
MM > 200V  
speed 3.3V applicans; it can be interfaced to 5V  
signal environment for both inputs and outputs.  
It has same speed performance at 3.3V than 5V  
AC/ACT fmily, combined with a lower power  
consuption.  
This device is designed to be used with 3 state  
emory address drivers, etc.  
All inputs and outputs are equipped with  
protection circuits against static discharge, giving  
them 2KV ESD immunity and transient excess  
voltage.  
DESCRIPTION  
The 74LCX240 is a low voltage CMOS OCTAL  
BUS BUFFER fabricated with sub-micron silicon  
gate and double-layer metal wiring C MOS  
technology. It is ideal for low power and high  
2
Figure 1: Pin Connction And IEC Logic Symbols  
Rev. 6  
1/12  
September 2004  
1234567...12

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型号 品牌 获取价格 描述 数据表
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