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74LCX16500MTD

更新时间： 2024-11-03 22:45:59

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飞兆/仙童 - FAIRCHILD		总线收发器触发器逻辑集成电路光电二极管输出元件
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描述
Low Voltage 18-Bit Universal Bus Transceivers with 5V Tolerant Inputs and Outputs

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74LCX16500MTD 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Transferred	零件包装代码：	TSSOP
包装说明：	TSSOP, TSSOP56,.3,20	针数：	56
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.44
其他特性：	WITH INDEPENDENT OUTPUT ENABLE FOR EACH DIRECTION	控制类型：	INDEPENDENT CONTROL
计数方向：	BIDIRECTIONAL	系列：	LVC/LCX/Z
JESD-30 代码：	R-PDSO-G56	JESD-609代码：	e4
长度：	14 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	REGISTERED BUS TRANSCEIVER	最大I（ol）：	0.024 A
湿度敏感等级：	2	位数：	18
功能数量：	1	端口数量：	2
端子数量：	56	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出特性：	3-STATE
输出极性：	TRUE	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装等效代码：	TSSOP56,.3,20
封装形状：	RECTANGULAR	封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度（摄氏度）：	260	电源：	3.3 V
Prop。Delay @ Nom-Sup：	6 ns	传播延迟（tpd）：	8.4 ns
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	Bus Driver/Transceivers	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	2.5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：	GULL WING	端子节距：	0.5 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
翻译：	N/A	触发器类型：	NEGATIVE EDGE
宽度：	6.1 mm	Base Number Matches：	1

74LCX16500MTD 数据手册

March 1995

Revised June 2002

74LCX16500

Low Voltage 18-Bit Universal Bus Transceivers with

5V Tolerant Inputs and Outputs

General Description

These 18-bit universal bus transceivers combine D-type

latches and D-type flip-flops to allow data flow in transpar-

ent, latched, and clocked modes.

Features

■ 5V tolerant inputs and outputs

■ 2.3V–3.6V V_CCspecifications provided

■ 6.0 ns t_PDmax (V_CC= 3.3V), 20 µA I_CCmax

Data flow in each direction is controlled by output-enable

(OEAB and OEBA), latch-enable (LEAB and LEBA), and

clock (CLKAB and CLKBA) inputs.

■ Power down high impedance inputs and outputs

■ Supports live insertion/withdrawal (Note 1)

■ ±24 mA output drive (V_CC= 3.0V)

The LCX16500 is designed for low voltage (2.5V or 3.3V)

V_CCapplications with the capability of interfacing to a 5V

■ Uses patented noise/EMI reduction circuitry

■ Latch-up performance exceeds 500 mA

■ ESD performance:

signal environment.

The LCX16500 is fabricated with an advanced CMOS tech-

nology to achieve high speed operation while maintaining

CMOS low power.

Human body model > 2000V

Machine model > 200V

■ Also packaged in plastic Fine-Pitch Ball Grid Array

(FBGA)

Note 1: To ensure the high-impedance state during power up or down, OE

should be tied to V_CCand OE tied to GND through a resistor: the minimum

value or the resistor is determined by the current-sourcing capability of the

driver.

Ordering Code:

Order Number Package Number

Package Description

74LCX16500G

(Note 2)(Note 3)

BGA54A

54-Ball Fine-Pitch Ball Grid Array (FBGA), JEDEC MO-205, 5.5mm Wide

56-Lead Shrink Small Outline Package (SSOP), JEDEC MO-118, 0.300" Wide

56-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 6.1mm Wide

74LCX16500MEA

(Note 3)

MS56A

MTD56

74LCX16500MTD

(Note 3)

Note 2: Ordering code “G” indicates Trays.

Note 3: Devices also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering code.

DS012407

www.fairchildsemi.com

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型号	品牌	获取价格	描述	数据表
74LCX16500MTDX	ONSEMI	获取价格	低压18位通用总线收发器，带5V容差输入和输出
74LCX16501	FAIRCHILD	获取价格	18-Bit Universal Bus Transceivers with 5V Tolerant Inputs and Outputs
74LCX16501MEA	FAIRCHILD	获取价格	18-Bit Universal Bus Transceivers with 5V Tolerant Inputs and Outputs
74LCX16501MEAX	ETC	获取价格	18-Bit Bus Transceiver
74LCX16501MTD	FAIRCHILD	获取价格	18-Bit Universal Bus Transceivers with 5V Tolerant Inputs and Outputs
74LCX16501MTD	ONSEMI	获取价格	18位通用总线收发器，带5V容差输入和输出
74LCX16501MTDX	ONSEMI	获取价格	18位通用总线收发器，带5V容差输入和输出
74LCX16501MTDX_NL	FAIRCHILD	获取价格	Registered Bus Transceiver, LVC/LCX/Z Series, 1-Func, 18-Bit, True Output, CMOS, PDSO56, 6
74LCX16541	STMICROELECTRONICS	获取价格	LOW VOLTAGE CMOS 16-BIT BUS BUFFER (3-STATE) WITH 5V TOLERANT INPUTS/OUTPUTS (NON INVERTED
74LCX16541TTR	STMICROELECTRONICS	获取价格	LOW VOLTAGE CMOS 16-BIT BUS BUFFER (3-STATE) WITH 5V TOLERANT INPUTS/OUTPUTS (NON INVERTED

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