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74LCX10MTCX_NL

更新时间： 2024-11-20 13:04:59

品牌	Logo	应用领域
飞兆/仙童 - FAIRCHILD		栅
页数	文件大小	规格书
8页	109K
描述
NAND Gate, LVC/LCX/Z Series, 3-Func, 3-Input, CMOS, PDSO14, 4.40 MM, LEAD FREE, MO-153, TSSOP-14

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74LCX10MTCX_NL 技术参数

生命周期：	Obsolete	零件包装代码：	TSSOP
包装说明：	TSSOP,	针数：	14
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.61	系列：	LVC/LCX/Z
JESD-30 代码：	R-PDSO-G14	JESD-609代码：	e3/e4
长度：	5 mm	逻辑集成电路类型：	NAND GATE
功能数量：	3	输入次数：	3
端子数量：	14	最高工作温度：	85 °C
最低工作温度：	-40 °C	封装主体材料：	PLASTIC/EPOXY
封装代码：	TSSOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	传播延迟（tpd）：	5.9 ns
认证状态：	Not Qualified	座面最大高度：	1.2 mm
最大供电电压 (Vsup)：	3.6 V	最小供电电压 (Vsup)：	2 V
标称供电电压 (Vsup)：	2.5 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子面层：	MATTE TIN/NICKEL PALLADIUM GOLD	端子形式：	GULL WING
端子节距：	0.65 mm	端子位置：	DUAL
宽度：	4.4 mm	Base Number Matches：	1

74LCX10MTCX_NL 数据手册

June 2000

Revised February 2005

74LCX10

Low Voltage Triple 3-Input NAND Gate

with 5V Tolerant Inputs

General Description

The LCX10 contains three 3-input NAND gates. The inputs

tolerate voltages up to 7V allowing the interface of 5V sys-

tems to 3V systems.

Features

■ 5V tolerant inputs

■ 2.3V–3.6V V_CCspecifications provided

■ 4.9 ns t_PDmax (V_CC3.3V), 10 A I_CCmax

■ Power down high impedance inputs and outputs

The 74LCX10 is fabricated with advanced CMOS technol-

ogy to achieve high speed operation while maintaining

CMOS low power dissipation.

■

24 mA output drive (V_CC3.0V)

■ Implements patented noise/EMI reduction circuitry

■ Latch-up performance exceeds 500 mA

■ ESD performance:

Human body model 2000V

Machine model 200V

Ordering Code:

Order Number Package Number

Package Description

74LCX10M

M14A

M14D

14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150" Narrow

Pb-Free 14-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide

14-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide

74LCX10SJ

74LCX10MTC

MTC14

Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.

Pb-Free package per JEDEC J-STD-020B.

Logic Symbol

Connection Diagram

IEEE/IEC

Pin Descriptions

Truth Table

O_nA_nB_nC_n

Pin Names

A_n, B_n, C_n

O_n

Description

Inputs

A_n

B_n

C_n

O_n

Outputs

HIGH Voltage Level

LOW Voltage Level

Immaterial

DS500453

www.fairchildsemi.com

12 3 4 5 6 7 8

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型号	品牌	获取价格	描述	数据表
74LCX10MX	FAIRCHILD	获取价格	Low Voltage Triple 3-Input NAND Gate with 5V Tolerant Inputs
74LCX10MX_NL	FAIRCHILD	获取价格	暂无描述
74LCX10SJ	FAIRCHILD	获取价格	Low Voltage Triple 3-Input NAND Gate with 5V Tolerant Inputs
74LCX10SJX	FAIRCHILD	获取价格	Low Voltage Triple 3-Input NAND Gate with 5V Tolerant Inputs
74LCX11	FAIRCHILD	获取价格	Low Voltage Triple 3-Input AND Gate with 5V Tolerant Inputs
74LCX11_08	FAIRCHILD	获取价格	Low Voltage Triple 3-Input AND Gate with 5V Tolerant Inputs
74LCX112	FAIRCHILD	获取价格	Low Voltage Dual J-K Negative Edge-Triggered Flip-Flop with 5V Tolerant Inputs
74LCX112M	FAIRCHILD	获取价格	Low Voltage Dual J-K Negative Edge-Triggered Flip-Flop with 5V Tolerant Inputs
74LCX112M	ROCHESTER	获取价格	LVC/LCX/Z SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO16
74LCX112M	ONSEMI	获取价格	低电压双 J-K 负向边触发触发器，带 5V 耐压输入

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