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74HCT4051N,112

更新时间： 2024-02-08 20:37:47

品牌	Logo	应用领域
恩智浦 - NXP		光电二极管
页数	文件大小	规格书
31页	242K
描述
74HC4051; 74HCT4051 - 8-channel analog multiplexer/demultiplexer DIP 16-Pin

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74HCT4051N,112 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	DIP	包装说明：	DIP, DIP16,.3
针数：	16	Reach Compliance Code：	compliant
HTS代码：	8542.39.00.01	风险等级：	7.85
其他特性：	ALSO OPERATES ON VCC-VEE 2 V TO 10 V SUPPLY	模拟集成电路 - 其他类型：	SINGLE-ENDED MULTIPLEXER
JESD-30 代码：	R-PDIP-T16	长度：	19.025 mm
信道数量：	8	功能数量：	1
端子数量：	16	标称断态隔离度：	50 dB
通态电阻匹配规范：	9 Ω	最大通态电阻 (Ron)：	180 Ω
最高工作温度：	125 °C	最低工作温度：	-40 °C
封装主体材料：	PLASTIC/EPOXY	封装代码：	DIP
封装等效代码：	DIP16,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	260
电源：	5,GND/-5 V	认证状态：	Not Qualified
座面最大高度：	4.2 mm	最大信号电流：	0.025 A
子类别：	Multiplexer or Switches	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	NO	最长断开时间：	68 ns
最长接通时间：	83 ns	切换：	BREAK-BEFORE-MAKE
技术：	CMOS	温度等级：	AUTOMOTIVE
端子面层：	NICKEL/PALLADIUM/GOLD (NI/PD/AU)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	宽度：	7.62 mm
Base Number Matches：	1

74HCT4051N,112 数据手册

74HC4051; 74HCT4051

8-channel analog multiplexer/demultiplexer

Rev. 7 — 19 July 2012

Product data sheet

1. General description

The 74HC4051; 74HCT4051 is a high-speed Si-gate CMOS device and is pin compatible

with Low-power Schottky TTL (LSTTL). The device is specified in compliance with JEDEC

standard no. 7A.

The 74HC4051; 74HCT4051 is an 8-channel analog multiplexer/demultiplexer with three

digital select inputs (S0 to S2), an active-LOW enable input (E), eight independent

inputs/outputs (Y0 to Y7) and a common input/output (Z). With E LOW, one of the eight

switches is selected (low impedance ON-state) by S0 to S2. With E HIGH, all switches are

in the high-impedance OFF-state, independent of S0 to S2.

V_CCand GND are the supply voltage pins for the digital control inputs (S0 to S2, and E).

The V_CCto GND ranges are 2.0 V to 10.0 V for 74HC4051 and 4.5 V to 5.5 V for

74HCT4051. The analog inputs/outputs (Y0 to Y7, and Z) can swing between V_CCas a

positive limit and V_EEas a negative limit. V_CC V_EEmay not exceed 10.0 V.

For operation as a digital multiplexer/demultiplexer, V_EEis connected to GND (typically

ground).

2. Features and benefits

 Wide analog input voltage range from 5 V to +5 V

 Low ON resistance:

 80  (typical) at V_CC V_EE= 4.5 V

 70  (typical) at V_CC V_EE= 6.0 V

 60  (typical) at V_CC V_EE= 9.0 V

 Logic level translation: to enable 5 V logic to communicate with 5 V analog signals

 Typical ‘break before make’ built-in

 ESD protection:

 HBM JESD22-A114F exceeds 2000 V

 MM JESD22-A115-A exceeds 200 V

 CDM JESD22-C101E exceeds 1000 V

 Multiple package options

 Specified from 40 C to +85 C and 40 C to +125 C

3. Applications

 Analog multiplexing and demultiplexing

 Digital multiplexing and demultiplexing

 Signal gating

12 3 4 5 6 7...31

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