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74HCT112D PDF预览

74HCT112D

更新时间： 2024-11-19 11:12:39
品牌 Logo 应用领域
安世 - NEXPERIA PC光电二极管逻辑集成电路触发器
页数 文件大小 规格书
16页 262K
描述
Dual JK flip-flop with set and reset; negative-edge triggerProduction

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74HCT112D 技术参数

是否Rohs认证：符合生命周期：Active
包装说明：SOP,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：1.6
Samacsys Confidence：3Samacsys Status：Released
Samacsys PartID：162959Samacsys Pin Count：16
Samacsys Part Category：Integrated CircuitSamacsys Package Category：Small Outline Packages
Samacsys Footprint Name：SOT 109-1(SO16)Samacsys Released Date：2015-05-12 09:55:40
Is Samacsys：N系列：HCT
JESD-30 代码：R-PDSO-G16JESD-609代码：e4
长度：9.9 mm逻辑集成电路类型：J-K FLIP-FLOP
湿度敏感等级：1位数：2
功能数量：2端子数量：16
最高工作温度：125 °C最低工作温度：-40 °C
输出极性：COMPLEMENTARY封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE传播延迟（tpd）：60 ns
座面最大高度：1.75 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：1.27 mm
端子位置：DUAL触发器类型：NEGATIVE EDGE
宽度：3.9 mm最小 fmax：20 MHz
Base Number Matches：1

74HCT112D 数据手册

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74HC112; 74HCT112  
Dual JK flip-flop with set and reset; negative-edge trigger  
Rev. 4 — 11 January 2021  
Product data sheet  
1. General description  
The 74HC112; 74HCT112 is a dual negative-edge triggered JK flip-flop. It features individual J and  
K inputs, clock (nCP) set (nSD) and reset (nRD) inputs. It also has complementary nQ and nQ  
outputs. The set and reset are asynchronous active LOW inputs and operate independently of the  
clock input. The J and K inputs control the state changes of the flip-flops as described in the mode  
select function table. The J and K inputs must be stable one set-up time prior to the HIGH-to-LOW  
clock transition for predictable operation. Inputs include clamp diodes that enable the use of current  
limiting resistors to interface inputs to voltages in excess of VCC  
.
Schmitt-trigger action in the clock input makes the circuit highly tolerant to slower clock rise and fall  
times.  
2. Features and benefits  
•
Input levels:  
•
•
For 74HC112: CMOS level  
For 74HCT112: TTL level  
•
•
•
Asynchronous set and reset  
Specified in compliance with JEDEC standard no. 7A  
ESD protection:  
•
•
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V  
•
Specified from -40 °C to +85 °C and from -40 °C to +125 °C  
3. Ordering information  
Table 1. Ordering information  
Type number Package  
Temperature range Name  
Description  
Version  
74HC112D  
-40 °C to +125 °C  
-40 °C to +125 °C  
SO16  
plastic small outline package; 16 leads; body width 3.9 mm SOT109-1  
74HCT112D  
74HC112PW  
74HCT112PW  
TSSOP16 plastic thin shrink small outline package; 16 leads;  
body width 4.4 mm  
SOT403-1  
 
 
 
1234567...16

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