74HC74DR2G

更新时间： 2024-01-26 11:36:54

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安森美 - ONSEMI		触发器锁存器逻辑集成电路光电二极管栅
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描述
Dual D Flip−Flop with Set and Reset High−Performance Silicon−Gate CMOS

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74HC74DR2G 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	SOIC
包装说明：	SOP,	针数：	14
Reach Compliance Code：	unknown	风险等级：	5.57
Is Samacsys：	N	系列：	HC/UH
JESD-30 代码：	R-PDSO-G14	JESD-609代码：	e3
长度：	8.65 mm	逻辑集成电路类型：	D FLIP-FLOP
湿度敏感等级：	NOT SPECIFIED	位数：	1
功能数量：	2	端子数量：	14
最高工作温度：	125 °C	最低工作温度：	-55 °C
输出极性：	COMPLEMENTARY	封装主体材料：	PLASTIC/EPOXY
封装代码：	SOP	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE	峰值回流温度（摄氏度）：	260
传播延迟（tpd）：	150 ns	认证状态：	COMMERCIAL
座面最大高度：	1.75 mm	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	标称供电电压 (Vsup)：	3 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子面层：	MATTE TIN
端子形式：	GULL WING	端子节距：	1.27 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	40
触发器类型：	POSITIVE EDGE	宽度：	3.9 mm
Base Number Matches：	1

74HC74DR2G 数据手册

74HC74

Dual D Flip−Flop with Set

and Reset

High−Performance Silicon−Gate CMOS

The 74HC74 is identical in pinout to the LS74. The device inputs are

compatible with standard CMOS outputs; with pullup resistors, they

are compatible with LSTTL outputs.

This device consists of two D flip−flops with individual Set, Reset,

and Clock inputs. Information at a D−input is transferred to the

corresponding Q output on the next positive going edge of the clock

input. Both Q and Q outputs are available from each flip−flop. The Set

and Reset inputs are asynchronous.

http://onsemi.com

MARKING

DIAGRAMS

SOIC−14

D SUFFIX

CASE 751A

HC74G

AWLYWW

Features

• Output Drive Capability: 10 LSTTL Loads

• Outputs Directly Interface to CMOS, NMOS, and TTL

• Operating Voltage Range: 2.0 to 6.0 V

• Low Input Current: 1.0 mA

TSSOP−14

DT SUFFIX

CASE 948G

• High Noise Immunity Characteristic of CMOS Devices

• In Compliance with the JEDEC Standard No. 7A Requirements

• ESD Performance: HBM > 2000 V; Machine Model > 200 V

• Chip Complexity: 128 FETs or 32 Equivalent Gates

• Pb−Free Packages are Available

ALYW G

HC74

L, WL

= Device Code

= Assembly Location

= Wafer Lot

= Year

W, WW = Work Week

G or G

= Pb−Free Package

(Note: Microdot may be in either location)

ORDERING INFORMATION

See detailed ordering and shipping information in the package

dimensions section on page 4 of this data sheet.

Semiconductor Components Industries, LLC, 2007

Publication Order Number:

February, 2007 − Rev. 0

74HC74/D

12 3 4 5 6 7 8

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型号	品牌	获取价格	描述	数据表
74HC74D-T	NXP	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
74HC74DTR2	ONSEMI	获取价格	Dual D Flip−Flop with Set and Reset High−Performance Silicon−Gate CMOS
74HC74DTR2G	ONSEMI	获取价格	Dual D Flip−Flop with Set and Reset High−Performance Silicon−Gate CMOS
74HC74N	NXP	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
74HC74N,652	NXP	获取价格	74HC74N
74HC74N652	NXP	获取价格	Dual D-type flip-flop with set and reset; positive edge-trigger
74HC74N-B	PHILIPS	获取价格	D Flip-Flop, 2-Func, Positive Edge Triggered, CMOS, PDIP14
74HC74N-Q100U	NXP	获取价格	暂无描述
74HC74PW	NXP	获取价格	Dual D-type flip-flop with set and reset; positive-edge trigger
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