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74HC4053D PDF预览

74HC4053D

更新时间： 2024-11-13 11:11:23
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安世 - NEXPERIA /
页数 文件大小 规格书
27页 399K
描述
Triple 2-channel analog multiplexer/demultiplexerProduction

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74HC4053D 技术参数

是否Rohs认证：符合生命周期：Active
Reach Compliance Code：compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：4 weeks
风险等级：0.47Samacsys Confidence：
Samacsys Status：ReleasedSamacsys PartID：315963
Samacsys Pin Count：16Samacsys Part Category：Integrated Circuit
Samacsys Package Category：OtherSamacsys Footprint Name：SOIC127P600X175-16N
Samacsys Released Date：2017-01-12 09:39:31Is Samacsys：N
模拟集成电路 - 其他类型：SINGLE-ENDED MULTIPLEXERJESD-30 代码：R-PDSO-G16
JESD-609代码：e4湿度敏感等级：1
标称负供电电压 (Vsup)：信道数量：1
功能数量：3端子数量：16
标称断态隔离度：50 dB通态电阻匹配规范：8 Ω
最大通态电阻 (Ron)：160 Ω最高工作温度：125 °C
最低工作温度：-40 °C封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE峰值回流温度（摄氏度）：260
认证状态：Not Qualified标称供电电压 (Vsup)：6 V
表面贴装：YES最长断开时间：36 ns
最长接通时间：37 ns技术：CMOS
温度等级：AUTOMOTIVE端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子位置：DUAL
处于峰值回流温度下的最长时间：30Base Number Matches：1

74HC4053D 数据手册

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74HC4053; 74HCT4053  
Triple 2-channel analog multiplexer/demultiplexer  
Rev. 12 — 9 February 2023  
Product data sheet  
1. General description  
The 74HC4053; 74HCT4053 is a triple single-pole double-throw analog switch (3x SPDT) suitable  
for use in analog or digital 2:1 multiplexer/demultiplexer applications. Each switch features a digital  
select input (Sn), two independent inputs/outputs (nY0 and nY1) and a common input/output (nZ).  
A digital enable input (E) is common to all switches. When E is HIGH, the switches are turned off.  
Inputs include clamp diodes. This enables the use of current limiting resistors to interface inputs to  
voltages in excess of VCC  
.
2. Features and benefits  
•
Wide analog input voltage range from -5 V to +5 V  
•
CMOS low power dissipation  
•
•
•
High noise immunity  
Latch-up performance exceeds 100 mA per JESD78 Class II Level B  
Complies with JEDEC standard:  
•
•
JESD8C (2.7 V to 3.6 V)  
JESD7A (2.0 V to 6.0 V)  
•
Low ON resistance:  
•
•
•
80 Ω (typical) at VCC - VEE = 4.5 V  
70 Ω (typical) at VCC - VEE = 6.0 V  
60 Ω (typical) at VCC - VEE = 9.0 V  
•
•
•
Logic level translation: to enable 5 V logic to communicate with ±5 V analog signals  
Typical ‘break before make’ built-in  
ESD protection:  
•
•
•
HBM JESD22-A114F exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V  
CDM JESD22-C101E exceeds 1000 V  
•
•
Multiple package options  
Specified from -40 °C to +85 °C and -40 °C to +125 °C  
3. Applications  
•
•
•
Analog multiplexing and demultiplexing  
Digital multiplexing and demultiplexing  
Signal gating  
 
 
 
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74HC4053D 替代型号

型号 品牌 替代类型 描述 数据表
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