Datasheet > 逻辑 > 栅极> 74F08DCQM

74F08DCQM

更新时间： 2024-09-28 13:04:55

品牌	Logo	应用领域
飞兆/仙童 - FAIRCHILD		栅
页数	文件大小	规格书
5页	64K
描述
AND Gate, TTL, CDIP14,

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74F08DCQM 技术参数

是否无铅：	含铅	是否Rohs认证：	不符合
生命周期：	Obsolete	包装说明：	DIP, DIP14,.3
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.92	JESD-30 代码：	R-XDIP-T14
JESD-609代码：	e0	逻辑集成电路类型：	AND GATE
湿度敏感等级：	2A	端子数量：	14
最高工作温度：	70 °C	最低工作温度：
封装主体材料：	CERAMIC	封装代码：	DIP
封装等效代码：	DIP14,.3	封装形状：	RECTANGULAR
封装形式：	IN-LINE	峰值回流温度（摄氏度）：	250
电源：	5 V	认证状态：	Not Qualified
施密特触发器：	NO	子类别：	Gates
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	TTL	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn/Pb)	端子形式：	THROUGH-HOLE
端子节距：	2.54 mm	端子位置：	DUAL
处于峰值回流温度下的最长时间：	30	Base Number Matches：	1

74F08DCQM 数据手册

April 1988

Revised September 2000

74F08

Quad 2-Input AND Gate

General Description

This device contains four independent gates, each of which

performs the logic AND function.

Ordering Code:

Order Number Package Number

Package Description

74F08SC

74F08SJ

74F08PC

M14A

M14D

N14A

14-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-120, 0.150 Narrow

14-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide

14-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide

Devices also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.

Logic Symbol

Connection Diagram

IEEE/IEC

Unit Loading/Fan Out

Input I_IH/I_IL

U.L.

Pin Names

Description

Output I_OH/I_OL

HIGH/LOW

1.0/1.0

A_n, B_n

O_n

Inputs

20 µA/−0.6 mA

−1 mA/20 mA

Outputs

50/33.3

DS009457

www.fairchildsemi.com

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