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74ALVCH16501DGG,11

更新时间： 2024-09-16 14:48:43
品牌 Logo 应用领域
恩智浦 - NXP 光电二极管逻辑集成电路
页数 文件大小 规格书
18页 145K
描述
74ALVCH16501 - 18-bit universal bus transceiver; 3-state TSSOP 56-Pin

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74ALVCH16501DGG,11 技术参数

是否Rohs认证：符合生命周期：Transferred
零件包装代码：TSSOP包装说明：TSSOP, TSSOP56,.3,20
针数：56Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.31
Is Samacsys：N控制类型：INDEPENDENT CONTROL
计数方向：BIDIRECTIONAL系列：ALVC/VCX/A
JESD-30 代码：R-PDSO-G56JESD-609代码：e4
长度：14 mm负载电容（CL）：50 pF
逻辑集成电路类型：REGISTERED BUS TRANSCEIVER最大I（ol）：0.024 A
湿度敏感等级：1位数：18
功能数量：1端口数量：2
端子数量：56最高工作温度：85 °C
最低工作温度：-40 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装等效代码：TSSOP56,.3,20
封装形状：RECTANGULAR封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：3.3 VProp。Delay @ Nom-Sup：4.2 ns
传播延迟（tpd）：6.1 ns认证状态：Not Qualified
座面最大高度：1.2 mm子类别：Bus Driver/Transceivers
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：1.2 V
标称供电电压 (Vsup)：2.5 V表面贴装：YES
技术：CMOS温度等级：INDUSTRIAL
端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)端子形式：GULL WING
端子节距：0.5 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED翻译：N/A
触发器类型：POSITIVE EDGE宽度：6.1 mm
Base Number Matches：1

74ALVCH16501DGG,11 数据手册

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74ALVCH16501  
18-bit universal bus transceiver; 3-state  
Rev. 5 — 10 July 2012  
Product data sheet  
1. General description  
The 74ALVCH16501 is an 18-bit transceiver featuring non-inverting 3-state bus  
compatible outputs in both send and receive directions. Data flow in each direction is  
controlled by output enable (OEAB and OEBA), latch enable (LEAB and LEBA), and clock  
(CPAB and CPBA) inputs. For A-to-B data flow, the device operates in the transparent  
mode when LEAB is HIGH. When LEAB is LOW, the A data is latched if CPAB is held at a  
HIGH or LOW logic level. If LEAB is LOW, the A-bus data is stored in the latch/flip-flop on  
the LOW-to HIGH transition of CPAB. When OEAB is HIGH, the outputs are active. When  
OEAB is LOW, the outputs are in the high-impedance state.  
Data flow for B-to-A is similar to that of A-to-B but uses OEBA, LEBA and CPBA. The  
output enables are complimentary (OEAB is active HIGH, and OEBA is active LOW.  
To ensure the high-impedance state during power-up or power-down, OEBA should be  
tied to VCC through a pull-up resistor and OEAB should be tied to GND through a  
pull-down resistor; the minimum value of the resistor is determined by the  
current-sinking/current-sourcing capability of the driver.  
Active bus hold circuitry is provided to hold unused or floating data inputs at a valid logic  
level.  
2. Features and benefits  
Wide supply voltage range from 1.2 V to 3.6 V  
Complies with JEDEC standard JESD8-B  
CMOS low power consumption  
Direct interface with TTL levels  
Current drive 24 mA at VCC = 3.0 V  
Universal bus transceiver with D-type latches and D-type flip-flops capable of  
operating in transparent, latched or clocked mode  
All inputs have bus hold circuitry  
Output drive capability 50 transmission lines at 85 C  
3-state non-inverting outputs for bus-oriented applications  
 
 
1234567...18

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74ALVCH16501DGG,11 替代型号

型号 品牌 替代类型 描述 数据表
74ALVCH16501DGGRG4 TI

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 18-BIT UNIVERSAL BUS TRANSCEIVER WITH 3-STATE OUTPUTS

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