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74AHCT138PW

更新时间： 2024-11-21 11:10:51
品牌 Logo 应用领域
安世 - NEXPERIA 驱动光电二极管逻辑集成电路
页数 文件大小 规格书
15页 256K
描述
3-to-8 line decoder/demultiplexer; invertingProduction

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74AHCT138PW 技术参数

是否Rohs认证： 符合生命周期：Active
包装说明：TSSOP,Reach Compliance Code：compliant
HTS代码：8542.39.00.01风险等级：5.06
Is Samacsys：N系列：AHCT/VHCT/VT
输入调节：STANDARDJESD-30 代码：R-PDSO-G16
JESD-609代码：e4长度：5 mm
逻辑集成电路类型：OTHER DECODER/DRIVER湿度敏感等级：1
功能数量：1端子数量：16
最高工作温度：125 °C最低工作温度：-40 °C
输出极性：INVERTED封装主体材料：PLASTIC/EPOXY
封装代码：TSSOP封装形状：RECTANGULAR
封装形式：SMALL OUTLINE, THIN PROFILE, SHRINK PITCH峰值回流温度（摄氏度）：260
传播延迟（tpd）：14.5 ns认证状态：Not Qualified
座面最大高度：1.1 mm最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：YES技术：CMOS
温度等级：AUTOMOTIVE端子面层：Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式：GULL WING端子节距：0.65 mm
端子位置：DUAL处于峰值回流温度下的最长时间：30
宽度：4.4 mmBase Number Matches：1

74AHCT138PW 数据手册

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74AHC138; 74AHCT138  
3-to-8 line decoder/demultiplexer; inverting  
Rev. 5 — 10 September 2020  
Product data sheet  
1. General description  
The 74AHC138; 74AHCT138 are high-speed Si-gate CMOS devices and are pin compatible with  
Low power Schottky TTL (LSTTL). They are specified in compliance with JEDEC standard No. 7A.  
The 74AHC138; 74AHCT138 is a 3-to-8 line decoder/demultiplexer. It accepts three binary  
weighted address inputs (A0, A1 and A2) and, when enabled, provides eight mutually exclusive  
outputs (Y0 to Y7) that are LOW when selected.  
There are three enable inputs: two active LOW (E1 and E2) and one active HIGH (E3). Every  
output will be HIGH unless E1 and E2 are LOW and E3 is HIGH.  
This multiple enable function allows easy parallel expansion of the device to a 1-of-32 (5 lines to  
32 lines) decoder with just four 74AHC138; 74AHCT138 devices and one inverter. The 74AHC138;  
74AHCT138 can be used as an eight output demultiplexer by using one of the active LOW enable  
inputs as the data input and the remaining enable inputs as strobes. Unused enable inputs must be  
permanently tied to their appropriate active HIGH or LOW state.  
2. Features and benefits  
•
Balanced propagation delays  
•
•
•
•
•
•
•
•
All inputs have Schmitt-trigger action  
Demultiplexing capability  
Multiple input enable for easy expansion  
Ideal for memory chip select decoding  
Inputs accepts voltages higher than VCC  
For 74AHC138 only: operates with CMOS input levels  
For 74AHCT138 only: operates with TTL input levels  
ESD protection:  
•
•
•
HBM JESD22-A114E exceeds 2000 V  
MM JESD22-A115-A exceeds 200 V  
CDM JESD22-C101C exceeds 1000 V  
•
•
Multiple package options  
Specified from -40 °C to +85 °C and from -40 °C to +125 °C  
3. Ordering information  
Table 1. Ordering information  
Type number  
Package  
Temperature range Name  
Description  
Version  
74AHC138D  
-40 °C to +125 °C  
-40 °C to +125 °C  
-40 °C to +125 °C  
SO16  
plastic small outline package; 16 leads;  
body width 3.9 mm  
SOT109-1  
74AHCT138D  
74AHC138PW  
74AHCT138PW  
74AHC138BQ  
74AHCT138BQ  
TSSOP16  
plastic thin shrink small outline package; 16 leads;  
body width 4.4 mm  
SOT403-1  
SOT763-1  
DHVQFN16 plastic dual in-line compatible thermal enhanced  
very thin quad flat package; no leads; 16 terminals;  
body 2.5 × 3.5 × 0.85 mm  
 
 
 
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型号 品牌 获取价格 描述 数据表
74AHCT138PWDH NXP

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