74ACT138TTR

更新时间： 2024-11-24 22:25:11

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意法半导体 - STMICROELECTRONICS		解码器驱动器
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3 TO 8 LINE DECODER (INVERTING)

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74ACT138TTR 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
零件包装代码：	TSSOP	包装说明：	TSSOP, TSSOP16,.25
针数：	16	Reach Compliance Code：	unknown
ECCN代码：	EAR99	HTS代码：	8542.39.00.01
风险等级：	5.33	Is Samacsys：	N
系列：	ACT	输入调节：	STANDARD
JESD-30 代码：	R-PDSO-G16	JESD-609代码：	e4
长度：	5 mm	负载电容（CL）：	50 pF
逻辑集成电路类型：	OTHER DECODER/DRIVER	最大I（ol）：	0.024 A
湿度敏感等级：	1	功能数量：	1
端子数量：	16	最高工作温度：	125 °C
最低工作温度：	-55 °C	输出极性：	INVERTED
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP16,.25	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	包装方法：	TAPE AND REEL
峰值回流温度（摄氏度）：	260	电源：	5 V
Prop。Delay @ Nom-Sup：	10.5 ns	传播延迟（tpd）：	10.5 ns
认证状态：	Not Qualified	座面最大高度：	1.2 mm
子类别：	Decoder/Drivers	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	MILITARY	端子面层：	NICKEL PALLADIUM GOLD
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	NOT SPECIFIED
宽度：	4.4 mm	Base Number Matches：	1

74ACT138TTR 数据手册

74ACT138

3 TO 8 LINE DECODER (INVERTING)

■

HIGH SPEED: t = 5ns (TYP.) at V = 5V

PD CC

LOW POWER DISSIPATION:

= 4µA(MAX.) at T =25°C

■

COMPATIBLE WITH TTL OUTPUTS

= 2V (MIN.), V = 0.8V (MAX.)

50Ω TRANSMISSION LINE DRIVING

CAPABILITY

DIP

SOP

TSSOP

T & R

SYMMETRICAL OUTPUT IMPEDANCE:

|I | = I = 24mA (MIN)

BALANCED PROPAGATION DELAYS:

ORDER CODES

PACKAGE

PLH

PHL

TUBE

OPERATING VOLTAGE RANGE:

(OPR) = 4.5V to 5.5V

DIP

SOP

74ACT138B

74ACT138M

74ACT138MTR

74ACT138TTR

PIN AND FUNCTION COMPATIBLE WITH

74 SERIES 138

IMPROVED LATCH-UP IMMUNITY

TSSOP

Three enable inputs are provided to ease cascade

connection and application of address decoders

for memory systems.

The device is designed to interface directly High

Speed CMOS systems with TTL, NMOS and

CMOS output voltage levels.

DESCRIPTION

The 74ACT138 is an advanced high-speed CMOS

3 TO 8 LINE DECODER (INVERTING) fabricated

with sub-micron silicon gate and double-layer

metal wiring C MOS tecnology.

All inputs and outputs are equipped with

protection circuits against static discharge, giving

them 2KV ESD immunity and transient excess

voltage.

If the device is enabled, 3 binary select inputs (A,

B, and C) determine which one of the outputs will

go low. If enable input G1 is held low or either G2A

or G2B is held high, the decoding function is

inhibited and all the 8 outputs go to high.

PIN CONNECTION AND IEC LOGIC SYMBOLS

April 2001

1/10

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