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74ACT11238

更新时间： 2024-02-06 09:24:27
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德州仪器 - TI 解复用器
页数 文件大小 规格书
7页 96K
描述
3-LINE TO 8-LINE DECODER/DEMULTIPLEXER

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74ACT11238 技术参数

是否无铅： 含铅是否Rohs认证： 不符合
生命周期：Obsolete零件包装代码：DIP
包装说明：DIP, DIP16,.3针数：16
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01风险等级：5.81
其他特性：3 ENABLE INPUTS; CENTER VCC/GND PINS系列：ACT
输入调节：STANDARDJESD-30 代码：R-PDIP-T16
长度：19.305 mm负载电容（CL）：50 pF
逻辑集成电路类型：OTHER DECODER/DRIVER最大I（ol）：0.024 A
功能数量：1端子数量：16
最高工作温度：85 °C最低工作温度：-40 °C
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：DIP封装等效代码：DIP16,.3
封装形状：RECTANGULAR封装形式：IN-LINE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
Prop。Delay @ Nom-Sup：10.8 ns传播延迟（tpd）：10.8 ns
认证状态：Not Qualified座面最大高度：5.08 mm
子类别：Decoder/Drivers最大供电电压 (Vsup)：5.5 V
最小供电电压 (Vsup)：4.5 V标称供电电压 (Vsup)：5 V
表面贴装：NO技术：CMOS
温度等级：INDUSTRIAL端子形式：THROUGH-HOLE
端子节距：2.54 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.62 mm
Base Number Matches：1

74ACT11238 数据手册

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74ACT11238  
3-LINE TO 8-LINE DECODER/DEMULTIPLEXER  
SCAS054 – NOVEMBER 1988 – REVISED APRIL 1993  
D OR N PACKAGE  
(TOP VIEW)  
• Designed Specifically for High-Speed  
Memory Decoders and Data Transmission  
Systems  
1
2
3
4
5
6
7
8
16  
15  
14  
13  
12  
11  
10  
9
Y0  
A
B
Y1  
Y2  
Y3  
GND  
Y4  
Y5  
• Noninverting Version of ′ACT11138  
• Incorporates 3 Enable Inputs to Simplify  
Cascading and/or Data Reception  
C
V
• Inputs Are TTL-Voltage Compatible  
CC  
G1  
G2A  
G2B  
• Flow-Through Architecture Optimizes  
Y6  
Y7  
PCB Layout  
• Center-Pin V  
and GND Configurations  
Minimize High-Speed Switching Noise  
CC  
• EPIC (Enhanced-Performance Implanted  
CMOS) 1- m Process  
• 500-mA Typical Latch-Up Immunity  
at 125°C  
• Package Options Include Plastic  
Small-Outline Packages and Standard  
Plastic 300-mil DIPs  
description  
The 74ACT11238 circuit is designed to be used in high-performance memory-decoding or data-routing  
applications requiring very short propagation delay times. In high-performance memory systems, this decoder  
can be used to minimize the effects of system decoding. When employed with high-speed memories utilizing  
a fast enable circuit, the delay times of this decoder and the enable time of the memory are usually less than  
the typical access time of the memory. This means that the effective system delay introduced by the decoder  
is negligible.  
The conditions at the binary select inputs and the three enable inputs select one of eight input lines. Two  
active-low and one active-high enable inputs reduce the need for external gates or inverters when expanding.  
A 24-line decoder can be implemented without external inverters and a 32-line decoder requires only one  
inverter. An enable input can be used as a data input for demultiplexing applications.  
The 74ACT11238 is characterized for operation from – 40°C to 85°C.  
FUNCTION TABLE  
ENABLE  
INPUTS  
SELECT  
INPUTS  
OUTPUTS  
G1  
X
G2A  
H
X
X
L
G2B  
X
H
X
L
C
X
X
X
L
B
X
X
X
L
A
X
X
X
L
Y0  
L
Y1  
L
Y2  
L
Y3  
L
Y4  
L
Y5  
L
Y6  
L
Y7  
L
X
L
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H
EPIC is a trademark of Texas Instruments Incorporated.  
Copyright 1993, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
2–1  
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
1234567

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型号 品牌 描述 获取价格 数据表
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