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Datasheet > 逻辑 > 总线驱动器/收发器> 74AC373MTR
74AC373MTR PDF预览

74AC373MTR

更新时间： 2024-09-08 21:53:43
品牌 Logo 应用领域
意法半导体 - STMICROELECTRONICS 总线驱动器总线收发器逻辑集成电路光电二极管输出元件
页数 文件大小 规格书
11页 243K
描述
OCTAL D-TYPE LATCH WITH 3 STATE OUTPUT NON INVERTING

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74AC373MTR 技术参数

是否Rohs认证：符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOP-20
针数：20Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.09
Is Samacsys：N系列：AC
JESD-30 代码：R-PDSO-G20JESD-609代码：e3
长度：12.8 mm负载电容（CL）：50 pF
逻辑集成电路类型：BUS DRIVER最大I（ol）：0.012 A
湿度敏感等级：1位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP20,.4
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
包装方法：TAPE AND REEL峰值回流温度（摄氏度）：260
电源：3.3/5 VProp。Delay @ Nom-Sup：14 ns
传播延迟（tpd）：14 ns认证状态：Not Qualified
座面最大高度：2.65 mm子类别：FF/Latches
最大供电电压 (Vsup)：6 V最小供电电压 (Vsup)：2 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子面层：TIN端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：7.5 mm
Base Number Matches：1

74AC373MTR 数据手册

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74AC373  
OCTAL D-TYPE LATCH  
WITH 3 STATE OUTPUTS (NON INVERTED)  
■
■
HIGH SPEED: t = 5ns (TYP.) at V = 5V  
PD CC  
LOW POWER DISSIPATION:  
I
= 4µA(MAX.) at T =25°C  
CC  
A
■
■
■
■
■
■
■
HIGH NOISE IMMUNITY:  
= V = 28 % V (MIN.)  
50Ω TRANSMISSION LINE DRIVING  
CAPABILITY  
V
NIH  
NIL  
CC  
DIP  
SOP  
TSSOP  
T & R  
SYMMETRICAL OUTPUT IMPEDANCE:  
|I | = I = 24mA (MIN)  
OH  
OL  
BALANCED PROPAGATION DELAYS:  
ORDER CODES  
PACKAGE  
t
t
PLH  
PHL  
TUBE  
OPERATING VOLTAGE RANGE:  
(OPR) = 2V to 6V  
DIP  
SOP  
74AC373B  
74AC373M  
V
CC  
74AC373MTR  
74AC373TTR  
PIN AND FUNCTION COMPATIBLE WITH  
74 SERIES 373  
IMPROVED LATCH-UP IMMUNITY  
TSSOP  
logic level of D input data. While the (OE) input is  
low, the 8 outputs will be in a normal logic state  
(high or low logic level); while OE is in high level  
the outputs will be in a high impedance state.  
This device is designed to interface directly High  
Speed CMOS systems with TTL and NMOS  
components.  
DESCRIPTION  
The 74AC373 is a high-speed CMOS OCTAL  
D-TYPE LATCH with 3 STATE OUTPUT NON  
INVERTING fabricated with sub-micron silicon  
gate and double-layer metal wiring C MOS  
technology.  
2
All inputs and outputs are equipped with  
protection circuits against static discharge, giving  
them 2KV ESD immunity and transient excess  
voltage.  
These 8 bit D-Type latch are controlled by a latch  
enable input (LE) and an output enable input (OE).  
While the LE inputs is held at a high level, the Q  
outputs will follow the data input. When the LE is  
taken low, the Q outputs will be latched at the  
PIN CONNECTION AND IEC LOGIC SYMBOLS  
April 2001  
1/11  
1234567...11

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74AC373MTR 替代型号

型号 品牌 替代类型 描述 数据表
MC74AC373DWG ONSEMI

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型号 品牌 获取价格 描述 数据表
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