74AC138LC

更新时间： 2024-11-27 13:04:51

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飞兆/仙童 - FAIRCHILD		解码器解复用器
页数	文件大小	规格书
9页	103K
描述
Decoder/Driver, AC Series, Inverted Output, CMOS, CQCC20, CERAMIC, LCC-20

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74AC138LC 技术参数

生命周期：	Obsolete	零件包装代码：	QLCC
包装说明：	CERAMIC, LCC-20	针数：	20
Reach Compliance Code：	unknown	ECCN代码：	EAR99
HTS代码：	8542.39.00.01	风险等级：	5.62
Is Samacsys：	N	其他特性：	3 ENABLE INPUTS
系列：	AC	JESD-30 代码：	S-CQCC-N20
长度：	8.89 mm	功能数量：	1
端子数量：	20	最高工作温度：	85 °C
最低工作温度：	-40 °C	输出极性：	INVERTED
封装主体材料：	CERAMIC, METAL-SEALED COFIRED	封装代码：	QCCN
封装形状：	SQUARE	封装形式：	CHIP CARRIER
传播延迟（tpd）：	14 ns	认证状态：	Not Qualified
座面最大高度：	2.54 mm	最大供电电压 (Vsup)：	6 V
最小供电电压 (Vsup)：	2 V	表面贴装：	YES
技术：	CMOS	温度等级：	INDUSTRIAL
端子形式：	NO LEAD	端子节距：	1.27 mm
端子位置：	QUAD	宽度：	8.89 mm
Base Number Matches：	1

74AC138LC 数据手册

November 1988

Revised August 2000

74AC138 • 74ACT138

1-of-8 Decoder/Demultiplexer

General Description

Features

The AC/ACT138 is a high-speed 1-of-8 decoder/demulti-

plexer. This device is ideally suited for high-speed bipolar

memory chip select address decoding. The multiple input

enables allow parallel expansion to a 1-of-24 decoder

using just three AC/ACT138 devices or a 1-of-32 decoder

using four AC/ACT138 devices and one inverter.

■ I_CCreduced by 50%

■ Demultiplexing capability

■ Multiple input enable for easy expansion

■ Active LOW mutually exclusive outputs

■ Outputs source/sink 24 mA

■ ACT138 has TTL-compatible inputs

Ordering Code:

Order Number Package Number

Package Description

74AC138SC

74AC138SJ

74AC138MTC

74AC138PC

74ACT138SC

74ACT138SJ

74ACT138PC

M16A

M16D

MTC16

N16E

M16A

M16D

N16E

16-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150 Narrow

16-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide

16-Lead Thin Shrink Small Outline Package (TSSOP), JEDEC MO-153, 4.4mm Wide

16-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide

16-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-012, 0.150 Narrow

16-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide

16-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-001, 0.300 Wide

Device also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering code.

Connection Diagram

Logic Symbols

IEEE/IEC

Pin Descriptions

Pin Names

A₀–A₂

Description

Address Inputs

Enable Inputs

Enable Input

Outputs

E₁–E₂

E₃

O₀–O₇

FACT is a trademark of Fairchild Semiconductor Corporation.

DS009925

www.fairchildsemi.com

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