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74AUP1G125GW

更新时间： 2024-11-19 04:00:55

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恩智浦 - NXP		总线驱动器总线收发器逻辑集成电路光电二极管
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21页	105K
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Low-power buffer/line driver; 3-state

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74AUP1G125GW 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Transferred	零件包装代码：	TSSOT
包装说明：	1.25 MM, PLASTIC, MO-203, SC-88A, SOT353-1, TSSOP-5	针数：	5
Reach Compliance Code：	compliant	HTS代码：	8542.39.00.01
风险等级：	5.01	控制类型：	ENABLE LOW
系列：	AUP/ULP/V	JESD-30 代码：	R-PDSO-G5
JESD-609代码：	e3	长度：	2.05 mm
负载电容（CL）：	30 pF	逻辑集成电路类型：	BUS DRIVER
最大I（ol）：	0.0017 A	湿度敏感等级：	1
位数：	1	功能数量：	1
端口数量：	2	端子数量：	5
最高工作温度：	125 °C	最低工作温度：	-40 °C
输出特性：	3-STATE	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	TSSOP
封装等效代码：	TSSOP5/6,.08	封装形状：	RECTANGULAR
封装形式：	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	包装方法：	TAPE AND REEL
峰值回流温度（摄氏度）：	260	电源：	1.2/3.3 V
Prop。Delay @ Nom-Sup：	19 ns	传播延迟（tpd）：	24 ns
认证状态：	Not Qualified	座面最大高度：	1.1 mm
子类别：	Bus Driver/Transceivers	最大供电电压 (Vsup)：	3.6 V
最小供电电压 (Vsup)：	0.8 V	标称供电电压 (Vsup)：	1.1 V
表面贴装：	YES	技术：	CMOS
温度等级：	AUTOMOTIVE	端子面层：	Tin (Sn)
端子形式：	GULL WING	端子节距：	0.65 mm
端子位置：	DUAL	处于峰值回流温度下的最长时间：	30
宽度：	1.25 mm	Base Number Matches：	1

74AUP1G125GW 数据手册

74AUP1G125

Low-power buffer/line driver; 3-state

Rev. 02 — 30 June 2006

Product data sheet

1. General description

The 74AUP1G125 is a high-performance, low-power, low-voltage, Si-gate CMOS device,

superior to most advanced CMOS compatible TTL families. Schmitt-trigger action at all

inputs makes the circuit tolerant to slower input rise and fall times across the entire

V_CCrange from 0.8 V to 3.6 V. This device ensures a very low static and dynamic power

consumption across the entire V_CCrange from 0.8 V to 3.6 V.

This device is fully speciﬁed for partial Power-down applications using I_OFF

The I_OFFcircuitry disables the output, preventing the damaging backﬂow current through

the device when it is powered down.

The 74AUP1G125 provides the single non-inverting buffer/line driver with 3-state output.

The 3-state output is controlled by the output enable input (OE).

A HIGH level at pin OE causes the output to assume a high-impedance OFF-state. This

device has the input-disable feature, which allows ﬂoating input signals. The inputs are

disabled when OE is HIGH.

2. Features

I Wide supply voltage range from 0.8 V to 3.6 V

I High noise immunity

I Complies with JEDEC standards:

N JESD8-12 (0.8 V to 1.3 V)

N JESD8-11 (0.9 V to 1.65 V)

N JESD8-7 (1.2 V to 1.95 V)

N JESD8-5 (1.8 V to 2.7 V)

N JESD8-B (2.7 V to 3.6 V)

I ESD protection:

N HBM JESD22-A114-C Class 3A. Exceeds 5000 V

N MM JESD22-A115-A exceeds 200 V

N CDM JESD22-C101-C exceeds 1000 V

I Low static power consumption; I_CC= 0.9 µA (maximum)

I Latch-up performance exceeds 100 mA per JESD 78 Class II

I Inputs accept voltages up to 3.6 V

I Low noise overshoot and undershoot < 10 % of V_CC

I Input-disable feature allows ﬂoating input conditions

I I_OFFcircuitry provides partial Power-down mode operation

I Multiple package options

I Speciﬁed from −40 °C to +85 °C and −40 °C to +125 °C

12 3 4 5 6 7...21

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74AUP1G125GW 替代型号

型号	品牌	替代类型	描述	数据表
74AUP1G125GW	NEXPERIA	功能相似	Low-power buffer/line driver; 3-stateProduction
SN74AUP1G125DSFR	TI	功能相似	LOW-POWER SINGLE BUS BUFFER GATE WITH 3-STATE OUTPUT

与74AUP1G125GW相关器件

型号	品牌	获取价格	描述	数据表
74AUP1G125GW,125	NXP	获取价格	74AUP1G125 - Low-power buffer/line driver; 3-state TSSOP 5-Pin
74AUP1G125GW-Q100	NXP	获取价格	AUP/ULP/V SERIES, 1-BIT DRIVER, TRUE OUTPUT, PDSO5, 1.25 MM, PLASTIC, MO-203, SC-88A, SOT3
74AUP1G125GW-Q100	NEXPERIA	获取价格	Low-power buffer/line driver; 3-state
74AUP1G125GW-Q100H	NXP	获取价格	Low-power buffer/line driver; 3-state TSSOP 5-Pin
74AUP1G125GX	NEXPERIA	获取价格	Low-power buffer/line driver; 3-stateProduction
74AUP1G125-Q100	NEXPERIA	获取价格	Low-power buffer/line driver; 3-state
74AUP1G125SE	DIODES	获取价格	SINGLE BUFFER GATE WITH 3-STATE OUTPUT
74AUP1G125SE-7	DIODES	获取价格	SINGLE BUFFER GATE WITH 3-STATE OUTPUT
74AUP1G126	DIODES	获取价格	SINGLE BUFFER GATE WITH 3-STATE OUTPUT
74AUP1G126	NXP	获取价格	Low-Power buffer/line driver; 3-state

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