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72V3682L15PFG8

更新时间： 2024-11-25 15:44:31

品牌	Logo	应用领域
艾迪悌 - IDT		时钟先进先出芯片内存集成电路
页数	文件大小	规格书
29页	252K
描述
Bi-Directional FIFO, 32KX36, 10ns, Synchronous, CMOS, PQFP120

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72V3682L15PFG8 技术参数

是否Rohs认证：	符合	生命周期：	Obsolete
Reach Compliance Code：	compliant	风险等级：	5.84
最长访问时间：	10 ns	最大时钟频率 (fCLK)：	66.7 MHz
JESD-30 代码：	S-PQFP-G120	内存密度：	1179648 bit
内存集成电路类型：	BI-DIRECTIONAL FIFO	内存宽度：	36
端子数量：	120	字数：	32768 words
字数代码：	32000	工作模式：	SYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	32KX36	封装主体材料：	PLASTIC/EPOXY
封装代码：	QFP	封装等效代码：	QFP120,.63SQ,16
封装形状：	SQUARE	封装形式：	FLATPACK
电源：	3.3 V	认证状态：	Not Qualified
最大待机电流：	0.005 A	子类别：	FIFOs
标称供电电压 (Vsup)：	3.3 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子形式：	GULL WING	端子节距：	0.4 mm
端子位置：	QUAD	Base Number Matches：	1

72V3682L15PFG8 数据手册

3.3 VOLT CMOS SyncBiFIFO^TM

16,384 x 36 x 2

32,768 x 36 x 2

IDT72V3682

IDT72V3692

IDT72V36102

65,536 x 36 x 2

• Mailbox bypass register for each FIFO

• Programmable Almost-Full and Almost-Empty flags

• Microprocessor Interface Control Logic

FEATURES

• Memory storage capacity:

IDT72V3682 – 16,384 x 36 x 2

• FFA/IRA, EFA/ORA, AEA, and AFA flags synchronized by CLKA

• FFB/IRB, EFB/ORB, AEB, and AFB flags synchronized by CLKB

• Select IDT Standard timing (using EFA, EFB, FFA and FFB flags

functions) or First Word Fall Through timing (using ORA, ORB, IRA

and IRB flag functions)

• Available in space-saving 120-pin Thin Quad Flatpack (TQFP)

• Pin compatible to the lower density parts, IDT72V3622/72V3632/

72V3642/72V3652/72V3662/72V3672

IDT72V3692 – 32,768 x 36 x 2

IDT72V36102 – 65,536 x 36 x 2

• Supports clock frequencies up to 100MHz

• Fast access times of 6.5ns

• Free-running CLKA and CLKB may be asynchronous or coincident

(simultaneous reading and writing of data on a single clock edge

is permitted)

• Two independent clocked FIFOs buffering data in opposite direc-

tions

• Industrial temperature range (–40°C to +85°C) is available

• Green parts available, see ordering information

FUNCTIONAL BLOCK DIAGRAM

MBF1

Mail 1

CLKA

CSA

Port-A

Control

Logic

W/RA

RAM

ARRAY

16,384 x 36

32,768 x 36

65,536 x 36

ENA

MBA

FIFO1,

Mail1

Reset

Logic

RST1

Write

Pointer

Read

Pointer

Status Flag

Logic

EFB/ORB

AEB

FFA/IRA

AFA

FIFO 1

Programmable Flag

Offset Registers

Timing

Mode

FWFT

- A35

B0 - B35

FIFO 2

Status Flag

EFA/ORA

FFB/IRB

AFB

Logic

AEA

Read

Pointer

Write

Pointer

FIFO2,

Mail2

Reset

Logic

RST2

RAM

ARRAY

16,384 x 36

32,768 x 36

65,536 x 36

CLKB

CSB

Port-B

Control

Logic

W/RB

ENB

Mail 2

MBB

4679 drw 01

MBF2

IDTandtheIDTlogoareregisteredtrademarksofIntegratedDeviceTechnology,Inc. TheSyncBiFIFOisatrademarkofIntegratedDeviceTechnology,Inc.

COMMERCIAL TEMPERATURE RANGE

MAY 2008

DSC-4679/5

12 3 4 5 6 7...29

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