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723636L30PF

更新时间： 2024-11-19 19:42:23

品牌	Logo	应用领域
艾迪悌 - IDT		时钟先进先出芯片内存集成电路
页数	文件大小	规格书
35页	318K
描述
Bi-Directional FIFO, 1KX36, 15ns, Synchronous, CMOS, PQFP128

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723636L30PF 技术参数

是否Rohs认证：	不符合	生命周期：	Obsolete
Reach Compliance Code：	not_compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.71	风险等级：	5.92
最长访问时间：	15 ns	最大时钟频率 (fCLK)：	33 MHz
JESD-30 代码：	R-PQFP-G128	JESD-609代码：	e0
内存密度：	36864 bit	内存集成电路类型：	BI-DIRECTIONAL FIFO
内存宽度：	36	湿度敏感等级：	3
端子数量：	128	字数：	1024 words
字数代码：	1000	工作模式：	SYNCHRONOUS
最高工作温度：	70 °C	最低工作温度：
组织：	1KX36	封装主体材料：	PLASTIC/EPOXY
封装代码：	QFP	封装等效代码：	QFP128,.63X.87,20
封装形状：	RECTANGULAR	封装形式：	FLATPACK
峰值回流温度（摄氏度）：	260	电源：	5 V
认证状态：	Not Qualified	子类别：	FIFOs
标称供电电压 (Vsup)：	5 V	表面贴装：	YES
技术：	CMOS	温度等级：	COMMERCIAL
端子面层：	Tin/Lead (Sn85Pb15)	端子形式：	GULL WING
端子节距：	0.5 mm	端子位置：	QUAD
处于峰值回流温度下的最长时间：	6	Base Number Matches：	1

723636L30PF 数据手册

CMOS TRIPLE BUS SyncFIFO^TM

WITH BUS-MATCHING

256 x 36 x 2, 512 x 36 x 2

1,024 x 36 x 2

IDT723626

IDT723636

IDT723646

• Serial or parallel programming of partial flags

FEATURES:

• Big- or Little-Endian format for word and byte bus sizes

• Master Reset clears data and configures FIFO, Partial Reset

clears data but retains configuration settings

• Memory storage capacity:

IDT723626 – 256 x 36 x 2

IDT723636 – 512 x 36 x 2

IDT723646 – 1,024 x 36 x 2

• Mailbox bypass registers for each FIFO

• Free-running CLKA, CLKB and CLKC may be asynchronous or

coincident (simultaneous reading and writing of data on a single

clock edge is permitted)

• Auto power down minimizes power dissipation

• Available in a space-saving 128-pin Thin Quad Flatpack (TQFP)

• Clock frequencies up to 83 MHz (8ns access time)

• Two independent FIFOs buffer data between one bidirectional

36-bit port and two unidirectional 18-bit ports (Port C receives

and Port B transmits)

• 18-bit (word) and 9-bit (byte) bus sizing of 18 bits (word) on

Ports B and C

•

Industrial temperature range (–40°C to +85°C) is available

• Select IDT Standard timing (using EFA, EFB, FFA, and FFC flag

functions) or First Word Fall Through Timing (using ORA, ORB,

IRA, and IRC flag functions)

• Programmable Almost-Empty and Almost-Full flags; each has

three default offsets (8, 16 and 64)

DESCRIPTION:

The IDT723626/723636/723646 is a monolithic, high-speed, low-

power, CMOS Triple Bus synchronous (clocked) FIFO memory which

supportsclockfrequenciesupto83MHzandhasreadaccesstimesasfastas

FUNCTIONAL BLOCK DIAGRAM

MBF1

Mail 1

CLKA

CSA

Port-A

W/RA

Control

B0-B17

ENA

MBA

RAM ARRAY

256 x 36

512 x 36

1,024 x 36

Logic

CLKB

RENB

CSB

MBB

SIZEB

FIFO1,

Mail1

Reset

Logic

Port-B

Control

Logic

MRS1

PRS1

Write

Pointer

Read

Pointer

Status Flag

Logic

EFB/ORB

FFA/IRA

AEB

AFA

FIFO1

FIFO2

Common

Port

SPM

FS0/SD

Programmable Flag

Offset Registers

Control

Logic

Timing

Mode

FS1/SEN

(B and C)

A0-A35

FWFT

Status Flag

Logic

EFA/ORA

FFC/IRC

AFC

AEA

Read

Pointer

Write

Pointer

FIFO2,

Mail2

Reset

Logic

MRS2

PRS2

RAM ARRAY

256 x 36

C0-C17

512 x 36

1,024 x 36

CLKC

WENC

MBC

Port-C

Control

Logic

SIZEC

Mail 2

MBF2

3271 drw01

TheSyncFIFOisatrademarkandtheIDTlogoisaregisteredtrademarkofIntegratedDeviceTechnology,Inc.

COMMERCIALANDINDUSTRIALTEMPERATURERANGES

MARCH 2001

2001 Integrated Device Technology, Inc.

DSC-3271/2

12 3 4 5 6 7...35

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723641L15PFG8	IDT	获取价格	CMOS SyncFIFO
723641L15PFGI	IDT	获取价格	FIFO, 1KX36, 11ns, Synchronous, CMOS, PQFP120, TQFP-120
723641L15PQFGI	IDT	获取价格	FIFO, 1KX36, 11ns, Synchronous, CMOS, PQFP132, PLASTIC, QFP-132
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723641L20PFG	IDT	获取价格	FIFO, 1KX36, 13ns, Synchronous, CMOS, PQFP120, TQFP-120
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723641L20PFI	IDT	获取价格	TQFP-120, Tray

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