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71321LA25PFGI8

更新时间： 2024-11-20 00:22:11

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艾迪悌 - IDT		静态存储器内存集成电路
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18页	184K
描述
HIGH SPEED 2K X 8 DUAL-PORT STATIC RAM

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71321LA25PFGI8 技术参数

是否无铅：	不含铅	是否Rohs认证：	符合
生命周期：	Active	零件包装代码：	TQFP
包装说明：	LQFP, QFP64,.66SQ,32	针数：	64
Reach Compliance Code：	compliant	ECCN代码：	EAR99
HTS代码：	8542.32.00.41	风险等级：	5.09
最长访问时间：	25 ns	I/O 类型：	COMMON
JESD-30 代码：	S-PQFP-G64	JESD-609代码：	e3
长度：	14 mm	内存密度：	16384 bit
内存集成电路类型：	DUAL-PORT SRAM	内存宽度：	8
湿度敏感等级：	3	功能数量：	1
端口数量：	2	端子数量：	64
字数：	2048 words	字数代码：	2000
工作模式：	ASYNCHRONOUS	最高工作温度：	85 °C
最低工作温度：	-40 °C	组织：	2KX8
输出特性：	3-STATE	封装主体材料：	PLASTIC/EPOXY
封装代码：	LQFP	封装等效代码：	QFP64,.66SQ,32
封装形状：	SQUARE	封装形式：	FLATPACK, LOW PROFILE
并行/串行：	PARALLEL	峰值回流温度（摄氏度）：	260
电源：	5 V	认证状态：	Not Qualified
座面最大高度：	1.6 mm	最大待机电流：	0.004 A
最小待机电流：	2 V	子类别：	SRAMs
最大压摆率：	0.22 mA	最大供电电压 (Vsup)：	5.5 V
最小供电电压 (Vsup)：	4.5 V	标称供电电压 (Vsup)：	5 V
表面贴装：	YES	技术：	CMOS
温度等级：	INDUSTRIAL	端子面层：	Matte Tin (Sn) - annealed
端子形式：	GULL WING	端子节距：	0.8 mm
端子位置：	QUAD	处于峰值回流温度下的最长时间：	30
宽度：	14 mm	Base Number Matches：	1

71321LA25PFGI8 数据手册

HIGH SPEED

IDT71321SA/LA

IDT71421SA/LA

2K X 8 DUAL-PORT

STATIC RAM

WITH INTERRUPTS

LEAD FINISH (SnPb) ARE IN EOL PROCESS - LAST TIME BUY EXPIRES JUNE 15, 2018

Features

High-speed access

◆

MASTER IDT71321 easily expands data bus width to 16-or-

◆

more-bits using SLAVE IDT71421

◆

– Commercial: 20/25/35/55ns (max.)

– Industrial: 25/55ns (max.)

Low-power operation

On-chip port arbitration logic (IDT71321 only)

BUSY output flag on IDT71321; BUSY input on IDT71421

Fully asynchronous operation from either port

Battery backup operation – 2V data retention (LA only)

TTL-compatible, single 5V 10% power supply

Available in 52-Pin PLCC, 52-Pin STQFP, 64-Pin TQFP, and

64-Pin STQFP

◆

– IDT71321/IDT71421SA

— Active: 325mW (typ.)

— Standby: 5mW (typ.)

– IDT71321/421LA

◆

— Active: 325mW (typ.)

Industrial temperature range (–40°C to +85°C) is available

for selected speeds

— Standby: 1mW (typ.)

◆

Two INT flags for port-to-port communications

Green parts available, see ordering information

Functional Block Diagram

CER

R/W

R/WR

I/O0L- I/O7L

I/O0R-I/O7R

I/O

Control

BUSY ^(1,2)

(1,2)

BUSY

10L

10R

Address

Decoder

MEMORY

ARRAY

Address

Decoder

A0R

ARBITRATION

and

INTERRUPT

LOGIC

R/W

(2)

INT

2691 drw 01

NOTES:

1. IDT71321(MASTER):BUSYisopendrainoutputandrequirespullupresistorof270Ω.

IDT71421 (SLAVE): BUSY is input.

2. Open drain output: requires pullup resistor of 270Ω.

FEBRUARY 2018

DSC-2691/16

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