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5962R8969301VEA

更新时间： 2024-01-23 13:54:34

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德州仪器 - TI		输出元件逻辑集成电路触发器
页数	文件大小	规格书
12页	207K
描述
ACT SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CDIP16, CERAMIC, DIP-16

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技术参数
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5962R8969301VEA 技术参数

生命周期：	Obsolete	零件包装代码：	DIP
包装说明：	DIP,	针数：	16
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.84	系列：	ACT
JESD-30 代码：	R-GDIP-T16	JESD-609代码：	e0
逻辑集成电路类型：	D FLIP-FLOP	位数：	4
功能数量：	1	端子数量：	16
最高工作温度：	125 °C	最低工作温度：	-55 °C
输出极性：	COMPLEMENTARY	封装主体材料：	CERAMIC, GLASS-SEALED
封装代码：	DIP	封装形状：	RECTANGULAR
封装形式：	IN-LINE	传播延迟（tpd）：	12.5 ns
认证状态：	Not Qualified	筛选级别：	MIL-PRF-38535 Class V
最大供电电压 (Vsup)：	5.5 V	最小供电电压 (Vsup)：	4.5 V
标称供电电压 (Vsup)：	5 V	表面贴装：	NO
技术：	CMOS	温度等级：	MILITARY
端子面层：	TIN LEAD	端子形式：	THROUGH-HOLE
端子位置：	DUAL	总剂量：	100k Rad(Si) V
触发器类型：	POSITIVE EDGE	最小 fmax：	95 MHz
Base Number Matches：	1

5962R8969301VEA 数据手册

August 1998

54AC175 • 54ACT175

Quad D Flip-Flop

n Buffered positive edge-triggered clock

n Asynchronous common reset

n True and complement output

n Outputs source/sink 24 mA

n ’ACT175 has TTL-compatible inputs

n Standard Microcircuit Drawing (SMD)

— ’AC175: 5962-89552

General Description

The ’AC/’ACT175 is a high-speed quad D flip-flop. The de-

vice is useful for general flip-flop requirements where clock

and clear inputs are common. The information on the D in-

puts is stored during the LOW-to-HIGH clock transition. Both

true and complemented outputs of each flip-flop are pro-

vided. A Master Reset input resets all flip-flops, independent

of the Clock or D inputs, when LOW.

— ’ACT175: 5962-89693

Features

n Edge-triggered D-type inputs

Logic Symbols

Connection Diagrams

Pin Assignment

for DIP and Flatpak

DS100278-1

IEEE/IEC

DS100278-3

Pin Assignment for LCC

DS100278-2

DS100278-4

Pin Names

D₀–D₃

Description

Data Inputs

Clock Pulse Input

Master Reset Input

True Outputs

Q₀–Q₃

Complement Outputs

FACT^®is a registered trademark of Fairchild Semiconductor Corporation.

DS100278

www.national.com

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