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5962-9757801QCA

更新时间: 2023-06-19 15:35:20
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德州仪器 - TI 逻辑集成电路栅极
页数 文件大小 规格书
13页 468K
描述
军用 4 通道、2 输入、4.5V 至 5.5V 双极或非门 | J | 14 | -55 to 125

5962-9757801QCA 技术参数

生命周期:Active零件包装代码:QLCC
包装说明:LCC-20针数:20
Reach Compliance Code:not_compliantHTS代码:8542.39.00.01
Factory Lead Time:1 week风险等级:5.24
Is Samacsys:N系列:F/FAST
JESD-30 代码:S-CQCC-N20长度:8.89 mm
负载电容(CL):50 pF逻辑集成电路类型:NAND GATE
最大I(ol):0.001 A功能数量:4
输入次数:2端子数量:20
最高工作温度:125 °C最低工作温度:-55 °C
封装主体材料:CERAMIC, METAL-SEALED COFIRED封装代码:QCCN
封装形状:SQUARE封装形式:CHIP CARRIER
包装方法:TUBE峰值回流温度(摄氏度):NOT SPECIFIED
最大电源电流(ICC):13 mAProp。Delay @ Nom-Sup:7.5 ns
传播延迟(tpd):7 ns认证状态:Not Qualified
施密特触发器:NO筛选级别:MIL-M-38510 Class B
座面最大高度:2.03 mm最大供电电压 (Vsup):5.5 V
最小供电电压 (Vsup):4.5 V标称供电电压 (Vsup):5 V
表面贴装:YES技术:TTL
温度等级:MILITARY端子形式:NO LEAD
端子节距:1.27 mm端子位置:QUAD
处于峰值回流温度下的最长时间:NOT SPECIFIED宽度:8.89 mm
Base Number Matches:1

5962-9757801QCA 数据手册

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SN54F00, SN74F00  
QUADRUPLE 2-INPUT POSITIVE-NAND GATES  
SDFS035A – MARCH 1987 – REVISED OCTOBER 1993  
SN54F00 . . . J PACKAGE  
SN74F00 . . . D OR N PACKAGE  
(TOP VIEW)  
Package Options Include Plastic  
Small-Outline Packages, Ceramic Chip  
Carriers, and Standard Plastic and Ceramic  
300-mil DIPs  
1A  
1B  
1Y  
2A  
2B  
V
CC  
1
2
3
4
5
6
7
14  
13  
12  
11  
10  
9
4B  
4A  
4Y  
3B  
3A  
3Y  
description  
These devices contain four independent 2-input  
NAND gates. They perform the Boolean functions  
Y = A B or Y = A + B in positive logic.  
2Y  
GND  
8
The SN54F00 is characterized for operation over  
the full military temperature range of 55°C to  
125°C. The SN74F00 is characterized for  
operation from 0°C to 70°C.  
SN54F00 . . . FK PACKAGE  
(TOP VIEW)  
FUNCTION TABLE  
(each gate)  
3
2
1
20 19  
18  
INPUTS  
OUTPUT  
Y
1Y  
NC  
2A  
4
5
6
7
8
4A  
NC  
4Y  
NC  
3B  
A
B
H
X
L
17  
16  
15  
14  
H
L
L
H
H
NC  
2B  
X
9 10 11 12 13  
logic symbol  
1
1A  
2
&
3
6
NC – No internal connection  
1Y  
2Y  
3Y  
4Y  
1B  
4
2A  
5
2B  
9
3A  
10  
3B  
12  
4A  
13  
4B  
8
11  
This symbol is in accordance with ANSI/IEEE Std 91-1984 and  
IEC Publication 617-12.  
logic diagram (positive logic)  
1
2
1A  
1B  
3
1Y  
2Y  
3Y  
4Y  
4
5
2A  
2B  
6
8
9
3A  
3B  
10  
12  
13  
4A  
4B  
11  
Pin numbers shown are for the D, J, and N packages.  
Copyright 1993, Texas Instruments Incorporated  
PRODUCTION DATA information is current as of publication date.  
Products conform to specifications per the terms of Texas Instruments  
standard warranty. Production processing does not necessarily include  
testing of all parameters.  
2–3  
POST OFFICE BOX 655303 DALLAS, TEXAS 75265  

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