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Datasheet > 逻辑 > 总线驱动器/收发器> 5962-9681901QRA
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5962-9681901QRA

更新时间： 2024-02-26 02:33:52
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德州仪器 - TI 总线收发器逻辑集成电路输出元件
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19页 735K
描述
OCTAL BUS TRANSCEIVERS WITH 3-STATE OUTPUTS

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5962-9681901QRA 技术参数

生命周期：Active零件包装代码：DFP
包装说明：DFP-20针数：20
Reach Compliance Code：not_compliantECCN代码：EAR99
HTS代码：8542.39.00.01Factory Lead Time：20 weeks
风险等级：5.37Is Samacsys：N
控制类型：COMMON CONTROL计数方向：BIDIRECTIONAL
系列：AHCT/VHCT/VTJESD-30 代码：R-GDFP-F20
长度：13.09 mm负载电容（CL）：50 pF
逻辑集成电路类型：BUS TRANSCEIVER最大I（ol）：0.008 A
位数：8功能数量：1
端口数量：2端子数量：20
最高工作温度：125 °C最低工作温度：-55 °C
输出特性：3-STATE输出极性：TRUE
封装主体材料：CERAMIC, GLASS-SEALED封装代码：DFP
封装等效代码：FL20,.3封装形状：RECTANGULAR
封装形式：FLATPACK包装方法：TUBE
峰值回流温度（摄氏度）：NOT SPECIFIED电源：5 V
最大电源电流（ICC）：0.04 mAProp。Delay @ Nom-Sup：11 ns
传播延迟（tpd）：11 ns认证状态：Qualified
施密特触发器：No筛选级别：MIL-PRF-38535 Class Q
座面最大高度：2.45 mm子类别：Bus Driver/Transceiver
最大供电电压 (Vsup)：5.5 V最小供电电压 (Vsup)：4.5 V
标称供电电压 (Vsup)：5 V表面贴装：YES
技术：CMOS温度等级：MILITARY
端子形式：FLAT端子节距：1.27 mm
端子位置：DUAL处于峰值回流温度下的最长时间：NOT SPECIFIED
翻译：N/A宽度：6.92 mm
Base Number Matches：1

5962-9681901QRA 数据手册

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SCLS233N − OCTOBER 1995 − REVISED MARCH 2005  
D
D
Inputs Are TTL-Voltage Compatible  
D
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
Latch-Up Performance Exceeds 250 mA Per  
JESD 17  
− 1000-V Charged-Device Model (C101)  
SN54AHCT245 . . . J OR W PACKAGE  
SN74AHCT245 . . . DB, DGV, DW, N, NS,  
OR PW PACKAGE  
SN74AHCT245 . . . RGY PACKAGE  
(TOP VIEW)  
SN54AHCT245 . . . FK PACKAGE  
(TOP VIEW)  
(TOP VIEW)  
1
20  
DIR  
A1  
1
2
3
4
5
6
7
8
9
10  
20  
19  
18  
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16  
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13  
12  
11  
V
CC  
3
2
1 20 19  
18  
A3  
A4  
A5  
A6  
A7  
B1  
B2  
4
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6
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8
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9
A1  
A2  
A3  
A4  
A5  
A6  
A7  
A8  
OE  
B1  
B2  
B3  
B4  
B5  
B6  
B7  
OE  
B1  
B2  
B3  
B4  
B5  
B6  
B7  
B8  
17  
A2  
16 B3  
A3  
15  
B4  
B5  
A4  
14  
A5  
9 10 11 12 13  
A6  
A7  
A8  
10  
11  
GND  
description/ordering information  
These octal bus transceivers are designed for asynchronous two-way communication between data buses. The  
control-function implementation minimizes external timing requirements.  
The ’AHCT245 devices allow data transmission from the A bus to the B bus or from the B bus to the A bus,  
depending on the logic level at the direction-control (DIR) input. The output-enable (OE) input can be used to  
disable the device so that the buses effectively are isolated.  
To ensure the high-impedance state during power up or power down, OE should be tied to V through a pullup  
CC  
resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.  
ORDERING INFORMATION  
ORDERABLE  
PART NUMBER  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PDIP − N  
Tube  
SN74AHCT245N  
SN74AHCT245N  
QFN − RGY  
Tape and reel  
Tube  
SN74AHCT245RGYR HB245  
SN74AHCT245DW  
SOIC − DW  
AHCT245  
Tape and reel  
Tape and reel  
Tape and reel  
Tube  
SN74AHCT245DWR  
SN74AHCT245NSR  
SN74AHCT245DBR  
SN74AHCT245PW  
SN74AHCT245PWR  
SOP − NS  
AHCT245  
HB245  
−40°C to 85°C  
SSOP − DB  
TSSOP − PW  
HB245  
Tape and reel  
Tape and reel  
Tube  
TVSOP − DGV  
CDIP − J  
SN74AHCT245DGVR HB245  
SNJ54AHCT245J  
SNJ54AHCT245W  
SNJ54AHCT245FK  
SNJ54AHCT245J  
CFP − W  
Tube  
SNJ54AHCT245W  
SNJ54AHCT245FK  
−55°C to 125°C  
LCCC − FK  
Tube  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines  
are available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
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Copyright 2005, Texas Instruments Incorporated  
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1
POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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