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Datasheet > 逻辑 > 总线驱动器/收发器> 5962-9583201QSA
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5962-9583201QSA

更新时间： 2024-02-21 19:21:06
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德州仪器 - TI 总线驱动器总线收发器触发器逻辑集成电路输出元件信息通信管理
页数 文件大小 规格书
23页 744K
描述
3.3V ABT OCTAL EDGE-TRIGGERED D-TYPE FLIP FLOPS WITH 3 STATE OUTPUTS

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5962-9583201QSA 技术参数

是否Rohs认证： 不符合生命周期：Active
零件包装代码：DFP包装说明：DFP,
针数：20Reach Compliance Code：unknown
HTS代码：8542.39.00.01风险等级：5.39
Is Samacsys：N其他特性：BROADSIDE VERSION OF 374
系列：LVTJESD-30 代码：R-GDFP-F20
JESD-609代码：e0长度：13.09 mm
逻辑集成电路类型：BUS DRIVER位数：8
功能数量：1端口数量：2
端子数量：20最高工作温度：125 °C
最低工作温度：-55 °C输出特性：3-STATE
输出极性：TRUE封装主体材料：CERAMIC, GLASS-SEALED
封装代码：DFP封装形状：RECTANGULAR
封装形式：FLATPACK峰值回流温度（摄氏度）：NOT SPECIFIED
传播延迟（tpd）：5.9 ns认证状态：Qualified
筛选级别：MIL-PRF-38535 Class V座面最大高度：2.54 mm
最大供电电压 (Vsup)：3.6 V最小供电电压 (Vsup)：2.7 V
标称供电电压 (Vsup)：3.3 V表面贴装：YES
技术：BICMOS温度等级：MILITARY
端子面层：TIN LEAD端子形式：FLAT
端子节距：1.27 mm端子位置：DUAL
处于峰值回流温度下的最长时间：NOT SPECIFIED宽度：6.92 mm
Base Number Matches：1

5962-9583201QSA 数据手册

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SCBS688G − MAY 1997 − REVISED SEPTEMBER 2003  
D
D
D
D
Support Mixed-Mode Signal Operation (5-V  
Input and Output Voltages With 3.3-V V  
D
Bus Hold on Data Inputs Eliminates the  
Need for External Pullup/Pulldown  
Resistors  
)
CC  
Support Unregulated Battery Operation  
Down to 2.7 V  
D
D
Latch-Up Performance Exceeds 500 mA Per  
JESD 17  
Typical V  
<0.8 V at V  
(Output Ground Bounce)  
OLP  
CC  
= 3.3 V, T = 25°C  
ESD Protection Exceeds JESD 22  
− 2000-V Human-Body Model (A114-A)  
− 200-V Machine Model (A115-A)  
A
I
and Power-Up 3-State Support Hot  
off  
Insertion  
SN54LVTH574 . . . FK PACKAGE  
(TOP VIEW)  
SN74LVTH574 . . . RGY PACKAGE  
(TOP VIEW)  
SN54LVTH574 . . . J OR W PACKAGE  
SN74LVTH574 . . . DB, DW, NS,  
OR PW PACKAGE  
(TOP VIEW)  
1
20  
3
2
1 20 19  
18  
OE  
1D  
2D  
3D  
4D  
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6D  
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V
CC  
1
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9
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20  
19  
18  
17  
2Q  
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2
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6
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8D  
1Q  
2Q  
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4Q  
5Q  
6Q  
7Q  
8Q  
1Q  
2Q  
3Q  
17  
16  
15  
14  
16 4Q  
15 5Q  
9 10 11 12 13  
14  
13  
12  
11  
6Q  
7Q  
8Q  
CLK  
10  
11  
GND  
description/ordering information  
These octal flip-flops are designed specifically for low-voltage (3.3-V) V  
provide a TTL interface to a 5-V system environment.  
operation, but with the capability to  
CC  
ORDERING INFORMATION  
ORDERABLE  
TOP-SIDE  
MARKING  
†
PACKAGE  
T
A
PART NUMBER  
SN74LVTH574RGYR  
SN74LVTH574DW  
SN74LVTH574DWR  
SN74LVTH574NSR  
SN74LVTH574DBR  
SN74LVTH574PW  
SN74LVTH574PWR  
SN74LVTH574GQNR  
SN74LVTH574ZQNR  
SNJ54LVTH574J  
QFN − RGY  
SOIC − DW  
Tape and reel  
Tube  
LXH574  
LVTH574  
Tape and reel  
Tape and reel  
Tape and reel  
Tube  
SOP − NS  
LVTH574  
LXH574  
SSOP − DB  
−40°C to 85°C  
TSSOP − PW  
LXH574  
LXH574  
Tape and reel  
VFBGA − GQN  
Tape and reel  
VFBGA − ZQN (Pb-free)  
CDIP − J  
Tube  
Tube  
Tube  
SNJ54LVTH574J  
SNJ54LVTH574W  
SNJ54LVTH574FK  
CFP − W  
SNJ54LVTH574W  
SNJ54LVTH574FK  
−55°C to 125°C  
LCCC − FK  
†
Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are  
available at www.ti.com/sc/package.  
Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of  
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.  
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Copyright 2003, Texas Instruments Incorporated  
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POST OFFICE BOX 655303 • DALLAS, TEXAS 75265  
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