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0461-0048-01

更新时间： 2024-11-03 02:50:59

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BEL		延迟线逻辑集成电路光电二极管输入元件
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描述
8 TAP LEADING EDGE CONTROL 100K ECL DELAY MODULES

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0461-0048-01 技术参数

生命周期：	Obsolete	包装说明：	DIP, DIP24,.4
Reach Compliance Code：	unknown	HTS代码：	8542.39.00.01
风险等级：	5.61	Is Samacsys：	N
其他特性：	INPUT RISE TIME 1NS; TAP TO TAP DELAY TOL. [NS] VARIES	系列：	100K
输入频率最大值（fmax）：	26.0417 MHz	JESD-30 代码：	R-PDIP-T15
逻辑集成电路类型：	ACTIVE DELAY LINE	功能数量：	1
抽头/阶步数：	8	端子数量：	15
最高工作温度：	85 °C	最低工作温度：
输出特性：	OPEN-EMITTER	输出极性：	TRUE
封装主体材料：	PLASTIC/EPOXY	封装代码：	DIP
封装等效代码：	DIP24,.4	封装形状：	RECTANGULAR
封装形式：	IN-LINE	电源：	-4.5 V
可编程延迟线：	NO	Prop。Delay @ Nom-Sup：	48 ns
认证状态：	Not Qualified	座面最大高度：	9.525 mm
子类别：	Delay Lines	表面贴装：	NO
技术：	ECL	温度等级：	OTHER
端子形式：	THROUGH-HOLE	端子节距：	2.54 mm
端子位置：	DUAL	总延迟标称（td）：	48 ns
宽度：	10.16 mm	Base Number Matches：	1

0461-0048-01 数据手册

defining a degree of excellence

8 TAP LEADING EDGE CONTROL

100K ECL DELAY MODULES

Cat 42 R0

1.30 Max

9 10 11 12

.010 Min

Vee 18

In 24

.375 Max

.012

.008

Vcc 1, 6,

7, 13, 19

.12 Min

.018

.50

.045

.20

.90

.40 .02

(

)

bel DC

.50 Max

(

)

P/N

.50

.10

Part Numbers

Test Conditions @ 25^oC

Total

Delay

per Tap

Rise

Time

Ein

Pulse Voltage, Logic 1

Pulse Voltage, Logic 0

Rise Time

Pulse Width

Pulse Period

-0.9 Volts

-1.7 Volts

1.0 ns (20%-80%)

Total Delay + 10 ns

4 x Pulse Width

Thru-Hole

0461-0016-01

0461-0020-01

0461-0024-01

0461-0028-01

0461-0032-01

0461-0036-01

0461-0040-01

0461-0044-01

0461-0048-01

0461-0052-01

0461-0056-01

0461-0060-01

0461-0064-01

0461-0068-01

0461-0072-01

0461-0076-01

0461-0080-01

16 ns

20 ns

24 ns

28 ns

32 ns

36 ns

40 ns

44 ns

48 ns

52 ns

56 ns

60 ns

64 ns

68 ns

72 ns

76 ns

80 ns

2.0 ns

2.5 ns

3.0 ns

3.5 ns

4.0 ns

4.5 ns

5.0 ns

5.5 ns

6.0 ns

6.5 ns

7.0 ns

7.5 ns

8.0 ns

8.5 ns

9.0 ns

9.5 ns

10.0 ns

3 ns

4 ns

Trin

Vee

Supply Voltage

-5.0 Volts

Electrical Characteristics

Min. Max.

-4.2 -5.7

-1165 -870

-1830 -1475

-1025 -870

-1830 -1620

240

Units

Vee Supply Voltage

Vih Logic 1 Input Voltage

Vil Logic 0 Input Voltage

Voh Logic 1 Output Voltage

Vol Logic 0 Output voltage

Iih Logic 1 Input Current

Iil

Logic 0 Input Current

0.50

0^o

70^o

Ta Operating Free Air Temperature

PW Min. Input Pulse Width of Total Delay

Maximum Duty Cycle

300 PPM/^OC Typ.

(

)

Tc Temp. Coeff. of Total Delay TD

Tolerances

Notes

Epoxy encapsulated

Compatible with 100K ECL circuits

Performance warranty is limited to specified parameters listed

Input to Taps 1 ns or 4% , Whichever is Greater

Delays measured @ 50% levels on Leading Edge only

with outputs terminated in 50 ohm 1% to -2 V

Rise Times measured from 20% to 80% levels

Other Delays and Tolerances Available

Consult Sales

Drive Capabilities

Fan-out capabilities

70 ECL Loads Max.

Specifications subject to change without notice.

Corporate Office

Bel Fuse Inc.

Far East Office

Bel Fuse Ltd.

European Office

Bel Fuse Europe Ltd.

198 Van Vorst Street, Jersey City, NJ 07302-4496

Tel: 201-432-0463

Fax: 201-432-9542

E-Mail: BelFuse@belfuse.com

Internet: http://www.belfuse.com

8F/8 Luk Hop Street

San Po Kong

Kowloon, Hong Kong

Tel: 852-2328-5515

Fax: 852-2352-3706

Preston Technology Management Centre

Marsh Lane, Preston PR1 8UD

Lancashire, U.K.

Tel: 44-1772-556601

Fax: 44-1772-888366

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