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DG403DY

更新时间： 2025-07-22 19:05:47
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瑞萨 - RENESAS 开关
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12页 424K
描述
2电路IC开关2：145欧姆16-SOIC

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DG403DY 技术参数

是否Rohs认证： 不符合生命周期：Obsolete
零件包装代码：SOIC包装说明：SOIC-16
针数：16Reach Compliance Code：not_compliant
HTS代码：8542.39.00.01风险等级：5
Is Samacsys：N模拟集成电路 - 其他类型：SPDT
JESD-30 代码：R-PDSO-G16JESD-609代码：e0
标称负供电电压 (Vsup)：-15 V正常位置：NO/NC
信道数量：1功能数量：2
端子数量：16标称断态隔离度：72 dB
通态电阻匹配规范：3 Ω最大通态电阻 (Ron)：45 Ω
最高工作温度：85 °C最低工作温度：-40 °C
输出：SEPARATE OUTPUT封装主体材料：PLASTIC/EPOXY
封装代码：SOP封装等效代码：SOP16,.25
封装形状：RECTANGULAR封装形式：SMALL OUTLINE
电源：5,+-15 V认证状态：Not Qualified
子类别：Multiplexer or Switches标称供电电压 (Vsup)：15 V
表面贴装：YES最长断开时间：100 ns
最长接通时间：150 ns切换：BREAK-BEFORE-MAKE
技术：CMOS温度等级：INDUSTRIAL
端子面层：Tin/Lead (Sn/Pb)端子形式：GULL WING
端子节距：1.27 mm端子位置：DUAL
Base Number Matches：1

DG403DY 数据手册

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DG401, DG403  
Test Circuits and Waveforms (Continued)  
+5V  
+15V  
V
V+  
V
C
C
L
+15V  
+5V  
V+  
V
C
V
C
L
SIGNAL  
GENERATOR  
50  
V
S1  
D1  
S
0V, 2.4V  
AS REQUIRED  
IN  
IN  
X
0V, 2.4V  
1
0V, 2.4V  
NC  
IN  
2
IMPEDANCE  
ANALYZER  
V
V
V
D
D2  
S2  
ANALYZER  
C
R
L
C
V-  
-15V  
V-  
GND  
GND  
-15V  
FIGURE 7. CAPACITANCES TEST CIRCUIT  
FIGURE 6. CROSSTALK TEST CIRCUIT  
Application Information  
Dual Slope Integrators  
Peak Detector  
A acting as a comparator provides the logic drive for  
The DG403 is well suited to configure a selectable slope  
integrator. One control signal selects the timing capacitor C  
3
operating SW . The output of A is fed back to A and  
1
1
2
3
or C . Another one selects e or discharges the capacitor in  
compared to the analog input e . If e > e  
the output of  
2
IN  
IN IN  
OUT  
preparation for the next integration cycle.  
A is high keeping SW closed. This allows C to charge up  
3 1 1  
to the analog input voltage. When e goes below e  
, A  
IN  
OUT  
3
goes negative, turning SW off. The system will therefore  
1
store the most positive analog input experienced.  
+5V  
+15V  
V+  
V
L
S
S
D
D
e
1
1
2
OUT  
e
IN  
RESET  
3
SW  
SW  
2
IN  
S
1
C
C
1
2
D
D
3
4
2
INTEGRATE/  
RESET  
R
A
A
A
1
2
1
1
3
e
OUT  
-
+
TTL  
+
-
S
4
e
IN  
C
1
IN  
2
+
DG403  
-
DG401  
SCOPE  
SELECT  
GND  
V-  
-15V  
FIGURE 9. POSITIVE PEAK DETECTOR  
FIGURE 8. DUAL SLOPE INTEGRATOR  
FN3284 Rev 11.00  
Nov 20, 2006  
Page 6 of 12  
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